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參數(shù)資料
| 型號： | IDT82V3285EQG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 103/147頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PLL WAN SE STRATUM 100TQFP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 時(shí)鐘/頻率發(fā)生器，多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | 以太網(wǎng)，SONET/SDH，Stratum |
| 輸入： | CMOS，LVDS，PECL |
| 輸出： | CMOS，LVDS，PECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 5:5 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 622.08MHz |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 100-TQFP-EP（14x14） |
| 包裝： | 托盤 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁當(dāng)前第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁
IDT82V3285
WAN PLL
Programming Information
59
December 9, 2008
41
-
IN_FREQ_READ_CH[3:0]
42
IN_FREQ_VALUE[7:0]
44
-
IN2_FREQ
_HARD_A
LARM
IN2_NO_A
CTIVITY_A
LARM
IN2_PH_L
OCK_ALA
RM
-
IN1_FREQ
_HARD_A
LARM
IN1_NO_A
CTIVITY_A
LARM
IN1_PH_L
OCK_ALA
RM
45
-
IN4_FREQ
_HARD_A
LARM
IN4_NO_A
CTIVITY_A
LARM
IN4_PH_L
OCK_ALA
RM
-
IN3_FREQ
_HARD_A
LARM
IN3_NO_A
CTIVITY_A
LARM
IN3_PH_L
OCK_ALA
RM
48
-
IN5_FREQ
_HARD_A
LARM
IN5_NO_A
CTIVITY_A
LARM
IN5_PH_L
OCK_ALA
RM
T0 / T4 DPLL Input Clock Selection Registers
4A
-
IN[4:1]
-
4B
---
--
IN5
-
4C
-D
-
IN4_VALID IN3_VALID IN2_VALID IN1_VALID
-
4D
---
--
IN5_VALID
-
4E
HIGHEST_PRIORITY_VALIDATED[3:0]
CURRENTLY_SELECTED_INPUT[3:0]
4F
THIRD_HIGHEST_PRIORITY_VALIDATED[3:0]
SECOND_HIGHEST_PRIORITY_VALIDATED[3:0
]
50
-
T0_INPUT_SEL[3:0]
51
-
T4_LOCK_
T0
T0_FOR_T
4
T4_TEST_
T0_PH
T4_INPUT_SEL[3:0]
T0 / T4 DPLL State Machine Control Registers
52
EX_SYNC
_ALARM_
MON
T4_DPLL_
LOCK
T0_DPLL_
SOFT_FRE
Q_ALARM
T4_DPLL_
SOFT_FRE
Q_ALRAM
T0_DPLL_
LOCK
T0_DPLL_OPERATING_MODE[2:0]
53
-
T0_OPERATING_MODE[2:0]
54
-
T4_OPERATING_MODE[2:0]
T0 / T4 DPLL & APLL Configuration Registers
55
T0_APLL_PATH[3:0]
T0_GSM_OBSAI_16E1
_16T1_SEL[1:0]
T0_12E1_24T1_E3_T3
_SEL[1:0]
56
T0_DPLL_START_DAMPING[2:0]
T0_DPLL_START_BW[4:0]
57
T0_DPLL_ACQ_DAMPING[2:0]
T0_DPLL_ACQ_BW[4:0]
Table 41: Register List and Map (Continued)
Address
(Hex)
Register Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reference
Page
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT82V3288BCG | IC PLL WAN 3E STRATUM 2 208CABGA |
| IDT82V3355EDG | IC PLL WAN SYNC ETHERNET 64TQFP |
| IDT82V3358EDG | IC PLL WAN SYNC ETHERNET 64TQFP |
| IDTCSPT857DNLG8 | IC PLL CLK DVR SDRAM 40-VFQFPN |
| IDTCV105EPVG8 | IC CLK GEN DESKTOP PC 48-SSOP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| IDT82V3285EQG8 | 制造商:Integrated Device Technology Inc 功能描述:IC PLL WAN SE STRATUM 100TQFP |
| IDT82V3288 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:WAN PLL |
| IDT82V3288BC | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:WAN PLL |
| IDT82V3288BCG | 功能描述:IC PLL WAN 3E STRATUM 2 208CABGA RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 專用 系列:- 標(biāo)準(zhǔn)包裝:1,500 系列:- 類型:時(shí)鐘緩沖器/驅(qū)動(dòng)器 PLL:是 主要目的:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 電源電壓:3.3V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SSOP（0.209"，5.30mm 寬） 供應(yīng)商設(shè)備封裝:28-SSOP 包裝:帶卷 (TR) 其它名稱:93786AFT |
| IDT82V3352 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:SYNCHRONOUS ETHERNET WAN PLL |
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