參數(shù)資料
型號(hào)： IDT74AUCH16245BVI
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 總線收發(fā)器
英文描述： AUC SERIES, DUAL 8-BIT TRANSCEIVER, TRUE OUTPUT, PBGA56
封裝： VFBGA-56
文件頁數(shù)： 7/8頁
文件大?。?/td> 189K
代理商： IDT74AUCH16245BVI
INDUSTRIALTEMPERATURERANGE
IDT74AUCH16245
1.8V CMOS 16-BIT BUS TRANSCEIVER WITH 3-STATE OUTPUTS AND BUS-HOLD
7
Open
VLOAD
GND
VDD
Pulse
Generator
D.U.T.
RL
CL
RT
VIN
VOUT
(1)
SAME PHASE
INPUT TRANSITION
OPPOSITE PHASE
INPUT TRANSITION
0V
VOH
VOL
tPLH
tPHL
tPLH
OUTPUT
VDD
VT
VDD
VT
CONTROL
INPUT
tPLZ
0V
OUTPUT
NORMALLY
LOW
tPZH
0V
SWITCH
CLOSED
OUTPUT
NORMALLY
HIGH
ENABLE
DISABLE
SWITCH
OPEN
tPHZ
0V
VOL + VLZ
VOH
VT
tPZL
VLOAD/2
VDD
VT
VOL
VOH - VHZ
RL
TEST CIRCUITS AND WAVEFORMS
Propagation Delay
Test Circuits for All Outputs
Enable and Disable Times
NOTE:
1. Diagram shown for input Control Enable-LOW and input Control Disable-HIGH.
DEFINITIONS:
CL = Load capacitance: includes jig and probe capacitance.
RT = Termination resistance: should be equal to ZOUT of the Pulse Generator.
NOTE:
1. Pulse Generator for All Pulses: Rate
≤ 10MHz; Slew Rate ≥ 1V/ns.
Test
Switch
Open Drain
Disable Low
VLOAD
Enable Low
Disable High
GND
Enable High
All Other Tests
Open
SWITCH POSITION
TEST CONDITIONS(1)
Symbol
VDD = 0.8V
VDD = 1.2V±0.1V
VDD = 1.5V±0.1V
VDD = 1.8V±0.15V
VDD = 2.5V±0.2V
Unit
VLOAD
2xVDD
V
VT
VDD/2
V
VLZ
100
150
mV
VHZ
100
150
mV
RL
2
1
0.5
K
CL
15
30
pF
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PDF描述
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參數(shù)描述
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