IDT72V3611 3.3V, CMOS SyncFIFOTM 64 x 36 COMMERCIALTEMPERATURERANGE Figure 5. EF EF EF Fla" />
參數(shù)資料
型號: IDT72V3611L15PF
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 5/19頁
文件大小: 0K
描述: IC FIFO SYNC 64X36 15NS 120-TQFP
標準包裝: 45
系列: 72V
功能: 同步
存儲容量: 2.3K(64 x 36)
數(shù)據速率: 67MHz
訪問時間: 15ns
電源電壓: 3 V ~ 3.6 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 120-LQFP
供應商設備封裝: 120-TQFP(14x14)
包裝: 托盤
其它名稱: 72V3611L15PF
13
IDT72V3611 3.3V, CMOS SyncFIFOTM
64 x 36
COMMERCIALTEMPERATURERANGE
Figure 5. EF
EF
EF Flag Timing and First Data Read when the FIFO is Empty
NOTE:
1. tSKEW1 is the minimum time between a rising CLKA edge and a rising CLKB edge for EF to transition HIGH in the next CLKB cycle. If the time between the rising CLKA edge and rising
CLKB edge is less than tSKEW1, then the transition of EF HIGH may occur one CLKB cycle later than shown.
Figure 4. FIFO Read Cycle Timing
4657 drw 07
CLKB
EF
ENB
B0 - B35
MBB
CSB
W/
RB
tCLK
tCLKH
tCLKL
tENS2
tMDV
tEN
tA
tENH2
tENS2
tENH2
tENS2
tENH2
tDIS
No Operation
HIGH
PGB,
ODD/
EVEN
Previous Data
Word 1
Word 2
tPGS
tPGH
tPGS
tPGH
CSA
W
RA
MBA
FFA
A0 - A35
CLKB
EF
CSB
W/
RB
MBB
ENA
CLKA
12
4657 drw 08
tCLKH
tCLKL
tCLK
tENS3
tENS2
tENH3
tENH2
tDS
tDH
tSKEW1
tCLK
tCLKL
tREF
tENS2
tENH2
tA
W1
Empty FIFO
LOW
HIGH
LOW
tCLKH
W1
HIGH
(1)
ENB
B0 - B35
相關PDF資料
PDF描述
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IDT72V3614L12PF IC FIFO 64X36X2 12NS 120QFP
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相關代理商/技術參數(shù)
參數(shù)描述
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