IDT72V263/273/283/293/103/113 3.3V HIGH DENSITY SUPERSYNC IITM NARROW BUS FIFO
參數資料
型號： IDT72V2113L6PFG
廠商： IDT, Integrated Device Technology Inc
文件頁數： 36/46頁
文件大小： 0K
描述： IC FIFO SUPERSYNCII 6NS 80TQFP
標準包裝： 45
系列： 72V
功能： 同步
存儲容量： 4.7Mb（262k x 18）
訪問時間： 4ns
電源電壓： 3.15 V ~ 3.45 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 80-LQFP
供應商設備封裝： 80-TQFP（14x14）
包裝： 托盤
其它名稱： 72V2113L6PFG
IDT72V2113L6PFG-ND
41
IDT72V263/273/283/293/103/113 3.3V HIGH DENSITY SUPERSYNC IITM NARROW BUS FIFO
8K x 18, 16K x 9/18, 32K x 9/18, 64K x 9/18, 128K x 9/18, 256K x 9/18, 512K x9
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72V2103/72V2113 3.3V HIGH DENSITY SUPERSYNC IITM NARROW BUS FIFO
131,072 x 18/262,144 x 9, 262,144 x 18/524,288 x 9
JUNE 1, 2010
Figure 31. Standard JTAG Timing
SYSTEM INTERFACE PARAMETERS
Parameter
Symbol
Test
Conditions
Min.
Max. Units
JTAG Clock Input Period tTCK
-
100
-
ns
JTAG Clock HIGH
tJTCKH
-40
-
ns
JTAG Clock Low
tJTCKL
-40
-
ns
JTAG Clock Rise Time
tJTCKR
--
5(1)
ns
JTAG Clock Fall Time
tJTCKF
--
5(1)
ns
JTAG Reset
tJRST
-50
-
ns
JTAG Reset Recovery
tJRSR
-50
-
ns
JTAG AC ELECTRICAL
CHARACTERISTICS
(VCC = 3.3V
± 5%; Tcase = 0°C to +85°C)
NOTE:
1. 50pf loading on external output signals.
NOTE:
1. Guaranteed by design.
tDS
tDH
TDO
TDI/
TMS
TCK
TRST(1)
tDO
6119 drw34
tJRSR
tJRST
tTCK
tJTCKR
tJTCKH
tJTCKL
tJTCKF
IDT72V2103
IDT72V2113
Parameter
Symbol
Test Conditions
Min.
Max.
Units
DataOutput
tDO(1)
-20
ns
Data Output Hold
tDOH(1)
0-
ns
Data Input
tDS
trise=3ns
10
-
ns
tDH
tfall=3ns
10
-
NOTE:
1. During power up,
TRST could be driven low or not be used since the JTAG circuit resets automatically. TRST is an optional JTAG reset.
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IDT72V2113L7-5PF 功能描述:IC FIFO SUPERSYNCII 7-5NS 80TQFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72V 標準包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數據速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應商設備封裝:24-PDIP 包裝:管件 其它名稱:74F433
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