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參數(shù)資料
| 型號： | IDT72T7285L4-4BBG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 52/53頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FIFO 16384X72 4.4NS 324BGA |
| 標準包裝： | 1 |
| 系列： | 72T |
| 訪問時間： | 3.2ns |
| 電源電壓： | 2.375 V ~ 2.625 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 324-BGA |
| 供應商設備封裝： | 324-PBGA（19x19） |
| 包裝： | 托盤 |
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8
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72T7285/72T7295/72T72105/72T72115 2.5V TeraSync
72-BIT FIFO
16,384 x 72, 32,768 x 72, 65,536 x 72, 131,072 x 72
TRST(2)
JTAG Reset
HSTL-LVTTL
TRSTisanasynchronousresetpinfortheJTAGcontroller.TheJTAGTAPcontrollerdoesnotautomatically
INPUT
reset upon power-up, thus it must be reset by either this signal or by setting TMS= HIGH for five TCK cycles.
If the TAP controller is not properly reset then the FIFO outputs will always be in high-impedance. If the JTAG
function is used but the user does not want to use
TRST, then TRST can be tied with MRS to ensure proper
FIFO operation. If the JTAG function is not used then this signal needs to be tied to GND.
WEN
WriteEnable
HSTL-LVTTL When Synchronous operation of the write port has been selected,
WEN enables WCLK for writing data into
INPUT
the FIFO memory and offset registers. If Asynchronous operation of the write port has been selected, the
WEN input should be tied LOW.
WCS
WriteChipSelect
HSTL-LVTTL This pin disables the write port data inputs when the device write port is configured for HSTL mode. This
INPUT
provides added power savings.
WCLK/
WriteClock/
HSTL-LVTTL If Synchronous operation of the write port has been selected, when enabled by
WEN,therisingedgeofWCLK
WR
WriteStrobe
INPUT
writes data into the FIFO. If Asynchronous operation of the write port has been selected, WR writes data into
the FIFO on a rising edge in an Asynchronous manner, (
WEN should be tied to its active state).
WHSTL(1) Write Port HSTL
LVTTL
This pin is used to select HSTL or 2.5V LVTTL inputs for the FIFO. If HSTL inputs are required, this input must
Select
INPUT
be tied HIGH. Otherwise it should be tied LOW.
VCC
+2.5v Supply
I
These are Vcc supply inputs and must be connected to the 2.5V supply rail.
GND
Ground Pin
I
These are Ground pins and must be connected to the GND rail.
Vref
Reference
I
This is a Voltage Reference input and must be connected to a voltage level determined from the table,
Voltage
“Recommended DC Operating Conditions”. This provides the reference voltage when using HSTL class
inputs. If HSTL class inputs are not being used, this pin should be tied LOW.
VDDQ
O/P Rail Voltage
I
This pin should be tied to the desired voltage rail for providing power to the output drivers.
PIN DESCRIPTION (CONTINUED)
Symbol
Name
I/O TYPE
Description
NOTES:
1. Inputs should not change state after Master Reset.
2. These pins are for the JTAG port. Please refer to pages 29-31 and Figures 6-8.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| V150A36T500B2 | CONVERTER MOD DC/DC 36V 500W |
| IDT72T7285L4-4BB | IC FIFO 16384X72 4-4NS 324-BGA |
| MAX1149BCUP+T | IC ADC 14BIT 116KSPS 20-TSSOP |
| V150A28T500BG3 | CONVERTER MOD DC/DC 28V 500W |
| MAX1148BCUP+T | IC ADC 14BIT 116KSPS 20-TSSOP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| IDT72T7295L10BB | 功能描述:IC FIFO 32768X72 10NS 324-BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標準包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應商設備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
| IDT72T7295L4-4BB | 功能描述:IC FIFO 32768X72 4-4NS 324-BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標準包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應商設備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
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