IDT723653/723663/723673 CMOS SyncFIFOTM WITH BUS-MATCHING" />
參數(shù)資料
型號: IDT723653L15PF8
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 15/29頁
文件大?。?/td> 0K
描述: IC FIFO SYNC 2048X36 128-TQFP
產(chǎn)品變化通告: Product Discontinuation 27/Jul/2009
標準包裝: 1,000
系列: 7200
功能: 同步
存儲容量: 72K(2K x 36)
數(shù)據(jù)速率: 67MHz
訪問時間: 15ns
電源電壓: 4.5 V ~ 5.5 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 128-LQFP
供應(yīng)商設(shè)備封裝: 128-TQFP(14x20)
包裝: 帶卷 (TR)
其它名稱: 723653L15PF8
22
COMMERCIALTEMPERATURERANGE
IDT723653/723663/723673 CMOS SyncFIFOTM WITH BUS-MATCHING
2,048 x 36 x 2, 4,096 x 36 x 2 and 8,192 x 36 x 2
NOTES:
1. tSKEW1 is the minimum time between a rising CLKA edge and a rising CLKB edge for
EF to transition HIGH in the next CLKB cycle. If the time between the rising CLKA edge and rising
CLKB edge is less than tSKEW1, then the transition of
EF HIGH may occur one CLKB cycle later than shown.
2. If Port B size is word or byte,
EF is set LOW by the last word or byte read from the FIFO, respectively.
Figure 12.
EF
EF Flag Timing and First Data Read when FIFO is Empty (IDT Standard Mode)
CSA
W/RA
MBA
FF
A0-A35
CLKB
EF
CSB
W/RB
MBB
ENA
ENB
B0-B35
CLKA
12
5610 drw14
tCLKH
tCLKL
tCLK
tENS2
tENH
tDS
tDH
tSKEW1
tCLK
tCLKL
tENS2
tENH
tA
W1
FIFO Empty
LOW
HIGH
LOW
HIGH
LOW
tCLKH
W1
HIGH
(1)
tREF
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PDF描述
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