參數(shù)資料
型號(hào)： IDT5V49EE702NDGI8
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 24/34頁(yè)
文件大?。?/td> 0K
描述： IC PLL CLK GEN 200MHZ 28VQFN
產(chǎn)品培訓(xùn)模塊： VersaClock™ III Programmable Clocks
特色產(chǎn)品： VersaClock III Timing Devices
標(biāo)準(zhǔn)包裝： 2,500
系列： VersaClock™ III
類型： 時(shí)鐘發(fā)生器，多路復(fù)用器
PLL： 帶旁路
輸入： LVCMOS，LVTTL，晶體
輸出： HCSL，LVCMOS，LVDS，LVPECL，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 2:7
差分 - 輸入:輸出： 無(wú)/是
頻率 - 最大： 500MHz
除法器/乘法器： 是/是
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 28-VFQFN 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝： 28-VFQFPN（4x4）
包裝： 帶卷 (TR)
其它名稱： IDT5V49EE702DLGI8
IDT5V49EE702DLGI8-ND
IDT5V49EE702
EEPROM PROGRAMMABLE CLOCK GENERATOR
CLOCK SYNTHESIZER
IDT EEPROM PROGRAMMABLE CLOCK GENERATOR
30
IDT5V49EE702
REV M 092412
Default Configuration: OUT1 = Reference Clock output, all other outputs turned off.
1. Memory bytes do not exist. Readback will be last value in shift register. If reading sequentially, value in 0x51 will be
returned.
0xCA
49
SRC6[2:0]_CFG4
SRC5[2:0]_CFG4
Reserved
SRC6
000 - Reserved
001 - Reserved
010 - Reference input
011 - Reserved
100 - Reserved
101 - PLL1
110 - Reserved
111 - Reserved
Quiet MUX
0xCB
49
SRC6[2:0]_CFG5
SRC5[2:0]_CFG5
0xCC
49
SRC6[2:0]_CFG0
SRC5[2:0]_CFG0
0xCD
49
SRC6[2:0]_CFG1
SRC5[2:0]_CFG1
0xCE
49
SRC6[2:0]_CFG2
SRC5[2:0]_CFG2
0xCF
49
SRC6[2:0]_CFG3
SRC5[2:0]_CFG3
Addr
Default
Register
Hex
Value
Bit #
Description
76
5
4
3
2
1
0
相關(guān)PDF資料
PDF描述
IDT5V49EE704NDGI8 IC PLL CLK GEN 200MHZ 28VFQFPN
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IDT5V49EE704NDGI8 功能描述:IC PLL CLK GEN 200MHZ 28VFQFPN RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:VersaClock™ III 標(biāo)準(zhǔn)包裝:1,000 系列:- 類型:時(shí)鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤(pán) 供應(yīng)商設(shè)備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT
IDT5V49EE901-064PGGI 制造商:Integrated Device Technology Inc 功能描述:IC PLL CLK GEN 500MHZ 24VQFN
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