參數(shù)資料
型號(hào): IDT5T9304PGG
廠商: IDT, Integrated Device Technology Inc
文件頁(yè)數(shù): 2/16頁(yè)
文件大小: 0K
描述: IC CLOCK BUFFER MUX 2:4 24-TSSOP
標(biāo)準(zhǔn)包裝: 62
系列: TERABUFFER™ II
類(lèi)型: 扇出緩沖器(分配),多路復(fù)用器
電路數(shù): 1
比率 - 輸入:輸出: 2:4
差分 - 輸入:輸出: 是/是
輸入: CML,eHSTL,HSTL,LVDS,LVEPECL,LVPECL,LVTTL
輸出: LVDS
頻率 - 最大: 450MHz
電源電壓: 2.3 V ~ 2.7 V
工作溫度: 0°C ~ 70°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 24-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 24-TSSOP
包裝: 管件
IDT5T9304 REVISION A MAY 16, 2013
10
2013 Integrated Device Technology, Inc.
IDT5T9304 Data Sheet
2.5V LVDS, 1:4 CLOCK BUFFER TERABUFFER
Power Down Timing
NOTE 1: It is recommended that outputs be disabled before entering power-down mode. It is also recommended that the outputs remain
disabled until the device completes power-up after asserting PD.
NOTE 2: The Power Down Timing diagram assumes that GL is HIGH.
NOTE 3: It should be noted that during power-down mode, the outputs are both pulled to VDD. In the Power Down Timing diagram this is
shown when Qn/Qn goes to VDIF = 0.
A1 - A1
G
VTHI
VIH
VIL
Qn - Qn
+VDIF
VDIF=0
-VDIF
+VDIF
VDIF=0
-VDIF
+VDIF
VDIF=0
-VDIF
PD
A2 - A2
VTHI
VIH
VIL
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