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參數(shù)資料
| 型號： | IDT23S09E |
| 廠商： | Integrated Device Technology, Inc. |
| 英文描述： | 3.3V ZERO DELAY CLOCK BUFFER, SPREAD SPECTRUM COMPATIBLE |
| 中文描述： | 3.3零延遲時鐘緩沖器，擴(kuò)頻兼容 |
| 文件頁數(shù)： | 2/8頁 |
| 文件大?。?/td> | 65K |
| 代理商： | IDT23S09E |
2
COMMERCIAL AND INDUSTRIAL TEMPERATURE RANGES
ABSOLUTE MAX IMUM RATINGS
(1)
IDT23S09E
3.3V ZERO DELAY CLOCK BUFFER
PIN CONFIGURATION
SOIC/ TSSOP
TOP VIEW
Symbol
V
DD
V
I (2)
V
I
Rating
Max.
Unit
V
V
V
Supply Voltage Range
Input Voltage Range (REF)
Input Voltage Range
(except REF)
Input Clamp Current
Continuous Output Current
Continuous Current
MaximumPower Dissipation
–0.5 to +4.6
–0.5 to +5.5
–0.5 to
V
DD
+0.5
–50
±50
±100
0.7
I
IK
(V
I
< 0)
I
O
(V
O
= 0 to V
DD
)
V
DD
or GND
T
A
= 55°C
(in still air)
(3)
T
STG
Operating
Temperature
Operating
Temperature
mA
mA
mA
W
Storage Temperature Range
Commercial Temperature
Range
Industrial Temperature
Range
–65 to +150
0 to +70
°C
°C
-40 to +85
°C
NOTES:
1. Stresses greater than those listed under ABSOLUTE MAXIMUMRATINGS may cause
permanent damage to the device. This is a stress rating only and functional operation
of the device at these or any other conditions above those indicated in the operational
sections of this specification is not implied. Exposure to absolute maximumrating
conditions for extended periods may affect reliability.
2. The input and output negative-voltage ratings may be exceeded if the input and output
clamp-current ratings are observed.
3. The maximumpackage power dissipation is calculated using a junction temperature
of 150°C and a board trace length of 750 mls.
NOTES:
1. Weak pull down.
2. Weak pull down on all outputs.
3. Weak pull ups on these inputs.
PIN DESCRIPTION
Pin Name
Pin Number
1
2
3
4, 13
5, 12
6
7
8
9
10
11
14
15
16
Type
IN
Out
Out
PWR
GND
Out
Out
IN
IN
Out
Out
Out
Out
Out
Functional Description
REF
(1)
CLKA1
(2)
CLKA2
(2)
V
DD
GND
CLKB1
(2)
CLKB2
(2)
S2
(3)
S1
(3)
CLKB3
(2)
CLKB4
(2)
CLKA3
(2)
CLKA4
(2)
CLKOUT
(2)
Input reference clock, 5 Volt tolerant input
Output clock for bank A
Output clock for bank A
3.3V Supply
Ground
Output clock for bank B
Output clock for bank B
Select input Bit 2
Select input Bit 1
Output clock for bank B
Output clock for bank B
Output clock for bank A
Output clock for bank A
Output clock, internal feedback on this pin
APPLICATIONS:
SDRAM
Telecom
Datacom
PC Motherboards/Workstations
Critical Path Delay Designs
REF
CLKA1
S2
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
1
CLKA2
GND
CLKB1
CLKOUT
CLKA4
GND
S1
V
DD
V
DD
CLKB2
CLKB3
CLKB4
CLKA3
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT23S09E-1DC | 3.3V ZERO DELAY CLOCK BUFFER, SPREAD SPECTRUM COMPATIBLE |
| IDT23S09E-1DCI | 3.3V ZERO DELAY CLOCK BUFFER, SPREAD SPECTRUM COMPATIBLE |
| IDT23S09E-1HDC | 3.3V ZERO DELAY CLOCK BUFFER, SPREAD SPECTRUM COMPATIBLE |
| IDT23S09E-1HDCI | 3.3V ZERO DELAY CLOCK BUFFER, SPREAD SPECTRUM COMPATIBLE |
| IDT23S09E-1HPG | 3.3V ZERO DELAY CLOCK BUFFER, SPREAD SPECTRUM COMPATIBLE |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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