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參數(shù)資料
| 型號： | ICS9FG104 |
| 英文描述： | Programmable FTG for Differential P4TM CPU, PCI-Express & SATA Clocks |
| 中文描述： | 可編程FTG微分P4TM的CPU和PCI - Express |
| 文件頁數(shù)： | 11/15頁 |
| 文件大小： | 162K |
| 代理商： | ICS9FG104 |
11
Integrated
Circuit
Systems, Inc.
ICS9FG104
0839D—06/02/05
SMBus Table: PLL Frequency Control Register
Pin #
Bit 7
PLL N Div8
Bit 6
PLL N Div9
Bit 5
PLL M Div5
Bit 4
PLL M Div4
Bit 3
PLL M Div3
Bit 2
PLL M Div2
Bit 1
PLL M Div1
-
Name
Control Function
N Divider Prog bit 8
N Divider Prog bit 9
Type
RW
RW
RW
RW
RW
RW
RW
0
1
PWD
X
X
X
X
X
X
X
Bit 0
PLL M Div0
RW
X
SMBus Table: PLL Frequency Control Register
Pin #
Bit 7
PLL N Div7
Bit 6
PLL N Div6
Bit 5
PLL N Div5
Bit 4
PLL N Div4
Bit 3
PLL N Div3
Bit 2
PLL N Div2
Bit 1
PLL N Div1
-
Name
Control Function
Type
RW
RW
RW
RW
RW
RW
RW
0
1
PWD
X
X
X
X
X
X
X
Bit 0
PLL N Div0
RW
X
SMBus Table: PLL Spread Spectrum Control Register
Pin #
Name
Bit 7
PLL SSP7
Bit 6
PLL SSP6
Bit 5
PLL SSP5
Bit 4
PLL SSP4
Bit 3
PLL SSP3
Bit 2
PLL SSP2
Bit 1
PLL SSP1
Bit 0
PLL SSP0
-
Control Function
Type
RW
RW
RW
RW
RW
RW
RW
RW
0
1
PWD
X
X
X
X
X
X
X
X
SMBus Table: PLL Spread Spectrum Control Register
Pin #
Name
Bit 7
Bit 6
PLL SSP14
Bit 5
PLL SSP13
Bit 4
PLL SSP12
Bit 3
PLL SSP11
Bit 2
PLL SSP10
Bit 1
PLL SSP9
Bit 0
PLL SSP8
-
Control Function
Reserved
Type
0
1
PWD
0
X
X
X
X
X
X
X
RW
RW
RW
RW
RW
RW
RW
Byte 10
-
-
-
-
-
-
The decimal
representation of M and
N Divider in Byte 11 and
12 will configure the PLL
VCO frequency.
Default at power up =
latch-in or Byte 0 Rom
table. VCO Frequency
= 14.318 x
[NDiv(9:0)+8] /
[MDiv(5:0)+2]
M Divider
Programming
bit (5:0)
-
Byte 11
-
-
-
-
-
-
N Divider
Programming Byte11
bit(7:0) and Byte10
bit(7:6)
The decimal
representation of M and
N Divider in Byte 11 and
12 will configure the PLL
VCO frequency.
Default at power up =
latch-in or Byte 0 Rom
table. VCO Frequency
= 14.318 x
[NDiv(9:0)+8] /
[MDiv(5:0)+2]
-
Byte 12
-
-
-
-
-
-
-
Spread Spectrum
Programming bit(7:0)
These Spread
Spectrum bits in Byte
13 and 14 will program
the spread pecentage
of PLL
Byte 13
-
-
Spread Spectrum
Programming bit(14:8)
These Spread
Spectrum bits in Byte
13 and 14 will program
the spread pecentage
of PLL
-
-
-
-
-
相關PDF資料 |
PDF描述 |
|---|---|
| ICS9FG107 | Programmable FTG for Differential CPU, PCI Express & SATA Clocks |
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參數(shù)描述 |
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