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參數(shù)資料
| 型號(hào)： | ICS9FG104 |
| 英文描述： | Programmable FTG for Differential P4TM CPU, PCI-Express & SATA Clocks |
| 中文描述： | 可編程FTG微分P4TM的CPU和PCI - Express |
| 文件頁數(shù)： | 10/15頁 |
| 文件大?。?/td> | 162K |
| 代理商： | ICS9FG104 |
10
Integrated
Circuit
Systems, Inc.
ICS9FG104
0839D—06/02/05
SMBus Table: Byte Count Register
Pin #
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
-
Name
BC7
BC6
BC5
BC4
BC3
BC2
BC1
BC0
Control Function
Type
RW
RW
RW
RW
RW
RW
RW
RW
0
-
-
-
-
-
-
-
-
1
-
-
-
-
-
-
-
-
PWD
0
0
0
0
0
1
1
1
SMBus Table: Reserved Register
Pin #
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
-
Name
Control Function
Reserved
Reserved
Reserved
Type
0
1
PWD
0
0
0
0
0
0
0
0
SMBus Table: Reserved Register
Pin #
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
-
Name
Control Function
Reserved
Reserved
Type
0
1
PWD
0
0
0
0
0
0
0
0
SMBus Table: M/N Programming Enable
Pin #
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
-
Name
Control Function
M/N Prog. Enable
Reserved
Type
RW
0
1
PWD
0
1
1
0
0
0
0
0
M/N_Enable
Disable
Enable
REFOUT_En
REFOUT Enable
Reserved
Reserved
RW
Disable
Enable
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Byte 6
Reserved
Writing to this register
will configure how
many bytes will be
read back, default is
07
= 7 bytes.
-
-
-
-
-
-
-
Reserved
-
-
-
-
Byte 7
-
-
-
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-
-
-
Byte 8
-
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-
5
-
-
-
-
Byte 9
-
-
Reserved
Reserved
Reserved
相關(guān)PDF資料 |
PDF描述 |
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| ICS9FG107 | Programmable FTG for Differential CPU, PCI Express & SATA Clocks |
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