IDTTM/ICSTM Four Output Differential Buff" />
參數(shù)資料
型號(hào)： ICS9DS400AGLF
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 15/19頁(yè)
文件大?。?/td> 0K
描述： IC CLK SPREAD INJECTION 28TSSOP
標(biāo)準(zhǔn)包裝： 50
類型： *
PLL： 帶旁路
輸入： 時(shí)鐘
輸出： 時(shí)鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:4
差分 - 輸入:輸出： 無(wú)/是
除法器/乘法器： 無(wú)/無(wú)
電源電壓： 3.3V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 28-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 28-TSSOP
包裝： 管件
IDTTM/ICSTM Four Output Differential Buffer for PCIe Gen 2 with Spread
1626
09/17/09
ICS9DS400
Four Output Differential Buffer for PCIe for Gen 2 with Spread
5
Advance Information
Absolute Max
Symbol
Parameter
Min
Max
Units
VDD
3.3V Supply Voltage
4.6
V
VIL
Input Low Voltage
GND-0.5
V
VIH
Input High Voltage
VDD+0.5V
V
Ts
Storage Temperature
-65
150
°C
Tcase
Case Temperature
115
°C
ESD prot
Input ESD protection
human body model
2000
V
Electrical Characteristics - Input/Supply/Common Output Parameters
TA =Over the Specified Operating Range; VDD = 3.3 V +/-5%
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS NOTES
Input High Voltage
VIH
3.3 V +/-5%
2
VDD + 0.3
V
1
Input Low Voltage
VIL
3.3 V +/-5%
GND - 0.3
0.8
V
1
Input High Current
IIH
VIN = VDD
-5
5
uA
1
IIL1
VIN = 0 V; Inputs with no pull-up resistors
-5
uA
1
IIL2
VIN = 0 V; Inputs with pull-up resistors
-200
uA
1
Operating Supply Current
IDD3.3OP
Full Active, CL = Full load;
125
mA
1
all diff pairs driven
30
mA
1
all differential pairs tri-stated
6
mA
1
FiPLL
PCIe Mode (Bypass#/PLL= 1)
90
100.00
110
MHz
1
FiBYPASS
Bypass Mode ((Bypass#/PLL= 0)
33
400
MHz
1
Pin Inductance
Lpin
7
nH
1
CIN
Logic Inputs, except SRC_IN
1.5
5
pF
1
CINSRC_IN
SRC_IN differential clock inputs
1.5
2.7
pF
1,4
COUT
Output pin capacitance
6
pF
1
Clk Stabilization
TSTAB
From VDD Power-Up and after input clock
stabilization or de-assertion of PD# to 1st
clock
1
ms
1,2
SS Modulation
Frequency
fMOD
Assuming 100 MHz input
(Triangular Modulation)
30
32.000
33
kHz
1
OE# Latency
tLATOE#
DIF start after OE# assertion
DIF stop after OE# deassertion
1
3
cycles
1,3
Tdrive_PD#
tDRVPD
DIF output enable after
PD# de-assertion
300
us
1,3
Tfall
tF
Fall time of PD# and SRC_STOP#
5
ns
1
Trise
tR
Rise time of PD# and SRC_STOP#
5
ns
2
SMBus Voltage
VMAX
Maximum input voltage
5.5
V
1
Low-level Output Voltage
VOL
@ IPULLUP
0.4
V
1
Current sinking at VOL
IPULLUP
4
mA
1
SCLK/SDATA
Clock/Data Rise Time
tRSMB
(Max VIL - 0.15) to
(Min VIH + 0.15)
1000
ns
1
SCLK/SDATA
Clock/Data Fall Time
tFSMB
(Min VIH + 0.15) to
(Max VIL - 0.15)
300
ns
1
SMBus Operating
Frequency
fMAXSMB
Maximum SMBus operating frequency
100
kHz
1,5
1Guaranteed by design and characterization, not 100% tested in production.
2See timing diagrams for timing requirements.
Input Low Current
Powerdown Current
Capacitance
5The differential input clock must be running for the SMBus to be active
Input Frequency
4SRC_IN input
IDD3.3PD
3Time from deassertion until outputs are >200 mV
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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ICS9DS800AFLF 功能描述:IC CLK SPREAD INJECTION 48SSOP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:1,000 系列:- 類型:時(shí)鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT
ICS9DS800AFLFT 功能描述:IC CLK SPREAD INJECTION 48SSOP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:1,000 系列:- 類型:時(shí)鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT
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