參數(shù)資料
型號: ICS952906AGLFT
英文描述: Programmable Timing Control Hub for Next Gen P4⑩ processor
中文描述: 可編程定時控制中心,為下一代的處理器?、?/td>
文件頁數(shù): 10/23頁
文件大?。?/td> 315K
代理商: ICS952906AGLFT
10
Integrated
Circuit
Systems, Inc.
ICS952906A
1236A—08/06/07
Table 5: Asynchronous 3V66/PCI Frequency Table
Byte6 Bit7
0
0
1
Byte3 Bit7
0
1
0
3V66/PCI Frequency
66.66/33.33
80.00/40.00
72.73/36.36
I
2
C Table: Output Control Register
Control
Function
Bit 7
48MHz_0
2x output drive
0=2x drive
RW
1
Bit 6
PCI ADIV
PCI Async Divider
Cntr
Reserved
Output Control
Reserved
Output Control
Output Control
Output Control
RW
0
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reserved
3V66_0
Reserved
PCICLK_F2
PCICLK_F1
PCICLK_F0
RW
RW
RW
RW
RW
RW
1
1
1
1
1
1
I
2
C Table: Reserved Register
Control
Function
Reserved
PLL Mode Selection
Bits
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reserved
Mode Sel1
Mode Sel0
3V66_2
M PLL2 Div3
M PLL2 Div2
M PLL2 Div1
M PLL2 Div0
RW
RW
RW
RW
RW
RW
RW
RW
0
0
0
1
X
X
X
X
Output Control
-
-
See Table 4: Mode Selection Table
Disable
Enable
Disable
Disable
Enable
Enable
-
-
Disable
Enable
AGP/2
PLL3 Freq/24
Disable
Enable
-
-
The decimal representation of M PLL2 Div
(3:0) + 2 is equal to REF divider value for
PLL2
0
1
0
1
-
-
-
-
PWD
7
Byte 5
Pin #
Name
Type
PWD
-
2x drive
normal
Name
Type
Byte 4
Pin #
M Divider
Programming bits for
Async mode 2&3
-
25
-
-
-
-
29
-
9
8
Table 4: Mode Selection Table
Mode
IIC Control
25MHz From
3V66/PCI From
Spreading
Standard Overclock Mode(I)
Byte 5 bit(6:5) = 00
PLL3
PLL1 (Needed to be align w/ CPU)
CPU/3V66/PCI have spread
CPU Overclock Mode(II)
Byte 5 bit(6:5) = 01
PLL3
PLL3
Only CPU clocks have spread.
Graphic Overclock Mode(III)
Byte 5 bit(6:5) = 10
PLL1
PLL3
Only CPU clocks have spread.
I
2
C Table: Vendor & Revision ID Register
Control
Function
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
ASEL0
N PLL2 Div6
N PLL2 Div5
N PLL2 Div4
N PLL2 Div3
N PLL2 Div2
N PLL2 Div1
N PLL2 Div0
3V66/PCI Freq Select
RW
RW
RW
RW
RW
RW
RW
RW
0
X
X
X
X
X
X
X
The decimal representation of N PLL2 Div
(6:0) + 8 is equal to VCO divider value for
PLL2.
Byte 6
Pin #
Name
-
-
-
-
-
-
PWD
-
-
N Divider
Programming bits for
Async mode 2&3
See Table 5: Async AGP/PCI Freq Table
0
1
Type
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PDF描述
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參數(shù)描述
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