參數(shù)資料
型號： ICS952702
英文描述： Programmable Timing Control Hub for K7 System
中文描述： 可編程定時控制中心的k7的系統(tǒng)
文件頁數(shù)： 7/17頁
文件大?。?/td> 160K
代理商： ICS952702
7
Integrated
Circuit
Systems, Inc.
ICS952702
0795D—05/06/05
B4 bit7
0
0
0
0
1
1
1
1
B4 bit6
0
0
1
1
0
0
1
1
B4 bit5
0
1
0
1
0
1
0
1
ZCLK
Main PLL
132
132
132
Main PLL
132
132
132
AGP
Main PLL
66
75.4
88
Main PLL
66
75.4
88
PCI
Main PLL
33
37.7
44
Main PLL
33
33
33
Table 2: Asynchronous Frequency Selection Table
Bit
0
*01
10
11
MSB
8
32
24
40
120
Div
1
4
3
5
15
Div
2
8
6
10
30
Div
4
16
12
20
60
Div
0
1
10
11
LSB
0
1
100
101
110
111
1000
1001
1010
1011
Address
1100
1101
1110
1111
Address
10
11
Address
Address
Table 3: AGP Divider Ratio Combination Table
Divider (3:2)
D
I
2
C Table: Revision ID & Output Divider Control Register
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
REV_ID3
REV_ID2
REV_ID1
REV_ID0
AGPDiv3
AGPDiv2
AGPDiv1
AGPDiv0
R
R
R
R
-
-
-
-
-
-
-
-
0
0
0
1
1
1
0
1
RW
RW
RW
RW
AGP divider ratio can be
configured via these 4
bits individually.
See Table 3: Divider Ratio Combination
Table
1
PWD
0
Control Function
Name
Type
-
-
-
-
-
-
-
-
Byte 5
Pin #
Revision ID
I
2
C Table: Async Frequency Selection & Output Skew Control Register
Bit 7
Bit 6
Bit 5
Bit 4
ASYNC2
ASYNC1
ASYNC0
Reserved
RW
RW
RW
RW
0
0
0
1
Reserved
-
-
Bit 3
ZCLKSkw1
RW
0
Bit 2
ZCLKSkw0
RW
1
Bit 1
AGPSkw1
RW
0
Bit 0
AGPSkw0
RW
1
Fix PLL Async Freq
Programming bits
See Table 2: Async Frequency Selection
Table
1
-
Byte 4
-
-
-
-
-
-
-
Pin #
Name
Type
Control Function
PWD
0
CPU-ZCLK Skew Control
00:0ps; 01:250ps; 10:500ps; 11:750ps
This byte will advance or delay the skew
by 250ps per step
CPU-AGP Skew Control
00:0ps; 01:250ps; 10:500ps; 11:750ps
This byte will advance or delay the skew
by 250ps per step
相關(guān)PDF資料
PDF描述
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ICS952801 Programmable Timing Control HubTM for K8TM processor
ICS952801yFT Programmable Timing Control HubTM for K8TM processor
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