參數(shù)資料
型號(hào)： ICS950403
英文描述： AMD - K8⑩ System Clock Chip
中文描述： AMD公司-的K8⑩系統(tǒng)時(shí)鐘芯片
文件頁數(shù)： 12/18頁
文件大?。?/td> 200K
代理商： ICS950403
12
ICS950403
Advance Information
0732—01/27/03
I
2
C Table: Drive Strength Control Register
Control
Function
Bit 7
PCI9/HTT3 DrCntrl
PCICLK9/HTTCLK3
Drive Strength Control
PCICLK6 Drive
Strength Control
PCICLK3 Drive
Strength Control
PCICLK2 Drive
Strength Control
PCICLK_F Drive
Strength Control
24_48MHz Drive
Strength Control
PCICLK8/HTTCLK2
Drive Strength Control
PCICLK7/HTTCLK1
Drive Strength Control
RW
1X
2X
1
Bit 6
PCI6Drv
RW
1X
2X
1
Bit 5
PCI3Drv
RW
1X
2X
1
Bit 4
PCI2Drv
RW
1X
2X
1
Bit 3
PCIFDrv
RW
1X
2X
1
Bit 2
24_48Drv
RW
1X
2X
1
Bit 1
PCI8/HTT2 DrCntrl
RW
1X
2X
1
Bit 0
PCI7/HTT1 DrCntrl
RW
1X
2X
1
I
2
C Table: Slew Rate Control Register
Control
Function
Reserved
Reserved
Reserved
Reserved
PCICLK(1:0) Slew
Rate Control
PCICLK(10, 5:4) Slew
Rate Control
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reserved
Reserved
Reserved
Reserved
PCISlw1
PCISlw0
PCISlw1
PCISlw0
RW
RW
RW
RW
RW
RW
RW
RW
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
1
0
1
0
1
0
1
0
I
2
C Table: Slew Rate Control Register
Control
Function
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
REFSlw1
REFSlw0
48MSlw1
48MSlw0
Reserved
Reserved
Reserved
Reserved
RW
RW
RW
RW
RW
RW
RW
RW
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
1
0
1
0
1
0
1
1
Reserved
Reserved
Reserved
Reserved
48MHz Slew Rate
Control
REF(2:0) Slew Rate
Control
0
1
-
-
-
PWD
-
-
Byte 24
Pin #
Name
Type
-
-
-
-
-
-
-
-
-
-
PWD
-
Byte 23
Pin #
Name
Type
-
-
1
0
-
-
-
-
PWD
-
-
Byte 22
Pin #
Name
Type
1
0
相關(guān)PDF資料
PDF描述
ICS950403 AMD - K8⑩ System Clock Chip
ICS950405 AMD - K8 System Clock Chip
ICS950410 AMD - K System Clock Chip
ICS950508 Programmable Timing Control HubTM for PII/IIITTM
ICS950508yFLF-T Programmable Timing Control HubTM for PII/IIITTM
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參數(shù)描述
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