參數(shù)資料
型號(hào)： ICS9178Y-03
英文描述： 245 MHz Clock Generator and Integrated Buffer for PowerPC™
文件頁(yè)數(shù)： 2/8頁(yè)
文件大?。?/td> 526K
代理商： ICS9178Y-03
2
ICS9178-03
Pin Configuration
44-Pin PQFP
*VCO range is limited from 75- 245 MHz at 5V ±5% and 60 - 170 MHz at 3.3V ±5%. Divide ratios assume BCLK is externally
fed back to FBCLK.
_=A,B,C
Functionality
The 2XPCLK series or Thevinen trace terminations must be optimized for the specific operating frequency and board
layout. The rising edge of ABCLK is coincident with the rising edges of 2XPCLK, PCLK and other BCLKs.
X_S1
0
0
1
1
X_S0
0
1
0
1
XCLK_(0,1)
PCLK
BCLK
DCLK
Tristate
FS1
0
0
1
1
X
0
0
1
1
FS0
0
1
0
1
X
0
1
0
1
RST
1
1
1
1
0
1
1
1
1
TEN
0
0
0
0
X
1
1
1
1
*VCO
6x REF
8x REF
4x REF
X
X
TCLK
TCLK
TCLK
TCLK
2XPCLK
VCO
VCO
VCO
1
0
TCLK
TCLK
TCLK
TCLK
PCLK
VCO/2
VCO/2
VCO/2
1
0
TCLK/2
TCLK/2
TCLK/2
TCLK/2
ABCLK (H/L%)
VCO/6 (66/33)
VCO/8 (75/25)
VCO/12 (50/50)
1
0
TCLK/6 (66/33)
TCLK/8 (75/25)
TCLK/12 ( 66/33)
TCLK/2
BCLK
VCO/6
VCO/8
VCO/4
1
0
TCLK/6
TCLK/8
TCLK/12
TCLK/2
DCLK
VCO/4
VCO/4
VCO/4
1
0
TCLK/4
TCLK/4
TCLK/4
TCLK/4
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PDF描述
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