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參數(shù)資料
| 型號： | ICS9170B-02CS08LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 7/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK SYNTHESIZER/MULT 8SOIC |
| 標準包裝： | 2,500 |
| 類型： | * |
| PLL： | 是 |
| 輸入： | 時鐘 |
| 輸出： | 時鐘 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:2 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 26.75MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 3.135 V ~ 5.25 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-SOIC（0.154"，3.90mm 寬） |
| 供應商設備封裝： | 8-SOIC |
| 包裝： | 帶卷 (TR) |
IDT9170B
CLOCK SYNCHRONIZER AND MULTIPLIER
CLOCK SYNTHESIZER
IDT CLOCK SYNCHRONIZER AND MULTIPLIER
4
IDT9170B
REV B 052609
Using CLK2 Feedback
Connecting CLK2 to FBIN as shown in Figure 2 will cause
all of the rising edges to be aligned (Figure 4).
Figure 2
For CLK2 frequencies 10 - 53.5 MHz* (-01)
For CLK2 frequencies 2.5 - 13.37 MHz (-02)
*Maximum 33.3 MHz@3.3 V (-01), 8.33 MHz@3.3 V (-02)
Table 2
Functionality Table for IDT9170B-01, -02 with CLK2 Feedback
Figure 4
Input and Output Clock Waveforms with CLK2 Connected to
FBIN
Using CLK1 Feedback
With CLK1 connected to FBIN as shown in Figure 3, the
input and CLK1 output will be aligned on the rising edge, but
CLK2 can be either rising or falling (Figure 5). Consult IDT if
the CLK1 frequency is desired to be higher than 107 MHz.
Figure 3
For CLK1 frequencies 20 - 107 MHz(-01)
For CLK1 frequencies 5 - 26.75 MHz (-02)
Maximum 66.7 MHz@3.3 V (-01), 16.7 MHz@3.3 V (-02)
Table 3
Functionality Table for IDT9170B-01, -02 with CLK2 Feedback
Figure 5
Input and Output Clock Waveforms with CLK1 Connected to
FBIN
FS1 FS0
CLK1
CLK2
0
INx4
INx2
0
1
INx8
INx4
1
0
INx2
IN
1
INx16
INx8
FS1 FS0
CLK1
CLK2
0
INx2
IN
0
1
INx4
INx2
1
0
IN
IN/2
1
INx8
INx4
相關PDF資料 |
PDF描述 |
|---|---|
| ICS91718CMLF | IC CLOCK GENERATOR LOW EMI 8SOIC |
| ICS91720BGLF | IC CLK GENERATOR LOW EMI 8-TSSOP |
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相關代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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