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參數(shù)資料
| 型號： | ICS87952AYI-147LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 10/13頁 |
| 文件大小： | 0K |
| 描述： | IC CLK MULT/ZD BUFFER 32-LQFP |
| 標準包裝： | 1,000 |
| 系列： | HiPerClockS™ |
| 類型： | 倍增器，零延遲緩沖器 |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL |
| 輸出： | LVCMOS，LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:11 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 180MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應商設備封裝： | 32-TQFP（7x7） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 87952AYI-147LFT |
ICS87952AYI-147 REVISION C AUGUST 4, 2009
6
2009 Integrated Device Technology, Inc.
ICS87952I-147 Data Sheet
LOW SKEW, 1-TO-11 LVCMOS/LVTTL CLOCK MULTIPLIER/ZERO DELAY BUFFER
APPLICATION INFORMATION
POWER SUPPLY FILTERING TECHNIQUES
As in any high speed analog circuitry, the power supply pins are
vulnerable to random noise. To achieve optimum jitter performance,
power supply isolation is required. The ICS87952I-147 provides
separate power supplies to isolate any high switching noise from
the outputs to the internal PLL. V
DD, VDDA, and VDDO should be indi-
vidually connected to the power supply plane through vias, and
0.01F bypass capacitors should be used for each pin.
Figure 1
illustrates this for a generic V
DD pin and also shows that VDDA re-
quires that an additional10
Ω resistor along with a 10F bypass
capacitor be connected to the V
DDA pin.
FIGURE 1. POWER SUPPLY FILTERING
VDD
VDDA
3.3V
10
Ω
10F
.01F
INPUTS:
LVCMOS CONTROL PINS
All control pins have internal pulldowns; additional resistance is
not required but can be added for additional protection. A 1k
Ω
resistor can be used.
RECOMMENDATIONS FOR UNUSED INPUT AND OUTPUT PINS
OUTPUTS:
LVCMOS OUTPUTS
All unused LVCMOS output can be left floating. There should be
no trace attached.
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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