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參數(shù)資料
| 型號： | ICS87002AG-02LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 4/16頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK GEN ZD 1:2 20-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 系列： | HiPerClockS™ |
| 類型： | 時(shí)鐘發(fā)生器，扇出配送，多路復(fù)用器，零延遲緩沖器 |
| PLL： | 帶旁路 |
| 輸入： | HCSL，HSTL，LVDS，LVPECL，SSTL |
| 輸出： | LVCMOS，LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:2 |
| 差分 - 輸入:輸出： | 是/無 |
| 頻率 - 最大： | 250MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 20-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 87002AG-02LFT |
ICS87002AG-02 REVISION C AUGUST 9, 2010
12
2010 Integrated Device Technology, Inc.
ICS87002-02 Data Sheet
1:2, DIFFERENTIAL-TO-LVCMOS/LVTTL ZERO DELAY CLOCK GENERATOR
Schematic Example
Figure 4 shows an example of ICS87002-02 application schematic.
In this example, the device is operated at VDD = 3.3V. The decoupling
capacitors should be located as close as possible to the power pin.
The input is driven by a 3.3V LVPECL driver.
Figure 4. ICS87002-02 Schematic Example
Recommendations for Unused Input and Output Pins
Inputs:
LVCMOS Control Pins
All control pins have internal pull-ups or pull-downs; additional
resistance is not required but can be added for additional protection.
A 1k
resistor can be used.
Outputs:
LVCMOS Outputs
All unused LVCMOS output can be left floating. There should be no
trace attached.
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PDF描述 |
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參數(shù)描述 |
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