參數(shù)資料
型號(hào)： ICS85311AMLF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 15/16頁
文件大?。?/td> 0K
描述： IC CLOCK BUFFER 1:2 1GHZ 8-SOIC
標(biāo)準(zhǔn)包裝： 97
系列： HiPerClockS™
類型： 扇出緩沖器（分配）
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 是/是
輸入： HCSL，LVDS，LVHSTL，LVPECL，SSTL
輸出： ECL，LVPECL
頻率 - 最大： 1GHz
電源電壓： 2.375 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 8-SOIC（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 8-SOIC
包裝： 管件
其它名稱： 800-1166
800-1166-5
800-1166-ND
85311AMLF
ICS85311
LOW SKEW, 1-TO-2, DIFFERENTIAL-TO-LVPECL/ECLFANOUT BUFFER
IDT / ICS LVPECL/ECL FANOUT BUFFER
8
ICS85311AM REV. D OCTOBER 22, 2008
Differential Clock Input Interface
The CLK /nCLK accepts LVDS, LVPECL, LVHSTL, SSTL, HCSL
and other differential signals. Both signals must meet the VPP and
VCMR input requirements. Figures 2A to 2F show interface
examples for the HiPerClockS CLK/nCLK input driven by the most
common driver types. The input interfaces suggested here are
examples only. Please consult with the vendor of the driver
component to confirm the driver termination requirements. For
example, in Figure 2A, the input termination applies for IDT
HiPerClockS open emitter LVHSTL drivers. If you are using an
LVHSTL driver from another vendor, use their termination
recommendation.
Figure 2A. HiPerClockS CLK/nCLK Input
Driven by an IDT Open Emitter
HiPerClockS LVHSTL Driver
Figure 2C. HiPerClockS CLK/nCLK Input
Driven by a 3.3V LVPECL Driver
Figure 2E. HiPerClockS CLK/nCLK Input
Driven by a 3.3V HCSL Driver
Figure 2B. HiPerClockS CLK/nCLK Input
Driven by a 3.3V LVPECL Driver
Figure 2D. HiPerClockS CLK/nCLK Input
Driven by a 3.3V LVDS Driver
Figure 2F. HiPerClockS CLK/nCLK Input
Driven by a 2.5V SSTL Driver
R1
50
R2
50
1.8V
Zo = 50
Zo = 50
CLK
nCLK
3.3V
LVHSTL
IDT
HiPerClockS
LVHSTL Driver
HiPerClockS
Input
R3
125
R4
125
R1
84
R2
84
3.3V
Zo = 50
Zo = 50
CLK
nCLK
3.3V
LVPECL
HiPerClockS
Input
HCSL
*R3
33
*R4
33
CLK
nCLK
2.5V
3.3V
Zo = 50
Zo = 50
HiPerClockS
Input
R1
50
R2
50
*Optional – R3 and R4 can be 0
CLK
nCLK
HiPerClockS
Input
LVPECL
3.3V
Zo = 50
Zo = 50
3.3V
R1
50
R2
50
R2
50
3.3V
R1
100
LVDS
CLK
nCLK
3.3V
Receiver
Zo = 50
Zo = 50
CLK
nCLK
HiPerClockS
SSTL
2.5V
Zo = 60
Zo = 60
2.5V
3.3V
R1
120
R2
120
R3
120
R4
120
相關(guān)PDF資料
PDF描述
ICS85314BMI-01LF IC CLOCK BUFFER MUX 2:5 20-SOIC
ICS85320AMILF IC CLK TRANSLA 1:1 267MHZ 8-SOIC
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ICS8533AG-01LFT IC CLOCK BUFFER MUX 2:4 20-TSSOP
ICS8533AGI-01LFT IC CLOCK BUFFER MUX 2:4 20-TSSOP
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參數(shù)描述
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