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參數(shù)資料
| 型號： | ICS844S42BKILF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 23/27頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SYNTHESIZER RF FREQ 56-VFQFPN |
| 標準包裝： | 260 |
| 系列： | HiPerClockS™ |
| 類型： | 頻率合成器 |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 2.592GHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 56-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 56-VFQFP-EP（8x8） |
| 包裝： | 托盤 |
| 其它名稱： | 844S42BKILF |
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ICS844S42BKI REVISION A FEBRUARY 21, 2012
5
2012 Integrated Device Technology, Inc.
ICS844S42I Data Sheet
DUAL OUTPUT RF FREQUENCY SYNTHESIZER
Device Configuration
The ICS844S42I supports an output frequency range of 81MHz to
2592MHz. The output frequency fOUT is a function of the reference
frequency fREF and the three internal PLL dividers P, M, and N. fOUT
can be represented by this formula:
fOUT = (fREF ÷ P) M ÷ (NA, NB)
The M, N and P dividers require a configuration by the user to
achieve the desired output frequency. The output dividers NA, NB
determine the achievable output frequency range (see Table 3A).
The PLL feedback-divider M is the frequency multiplication factor
and the main variable for frequency synthesis. For a given reference
frequency fREF, the PLL feedback-divider M must be configured to
match the specified VCO frequency range in order to achieve a valid
PLL configuration:
fVCO = (fREF ÷ P) M and 1296MHz fVCO 2592MHz
The output frequency may be changed at any time by changing the
value of the PLL feedback divider M. The smallest possible output
frequency change is the synthesizer granularity G (difference in fOUT
when incrementing or decrementing M). At a given reference
frequency, G is a function of the PLL pre-divider P and post-divider
N:
G = fREF ÷ (P NA, NB)
The purpose of the PLL pre-divider P is to situate the PLL into the
specified VCO frequency range fVCO (in combination with M). For a
given output frequency, P = ÷4 results in a smaller output frequency
granularity G, P = ÷2 results a larger output frequency granularity G
and also decreases the PLL bandwidth compared to the P = ÷4
setting. The following example illustrates the output frequency range
of the ICS844S42I using a 16MHz reference frequency.
Table 3A. Device Configuration Table for fREF = 16MHz)
Output Frequency (MHz)
NA, NB
M
P
G (MHz)
1296 – 2592
324 – 648
4
162 – 324
2
8
648 – 1296
2
324 – 648
4
2
162 – 324
2
4
432 – 864
3
324 – 648
4
1.33
162 – 324
2
2.66
324 – 648
4
324 – 648
4
1
162 – 324
2
216 – 432
6
324 – 648
4
0.66
162 – 324
2
1.33
162 – 324
8
324 – 648
4
0.5
162 – 324
2
1
81 – 162
16
324 – 648
4
0.25
162 – 324
2
0.5
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