參數(shù)資料
型號： ICS8430S07AKILF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 2/26頁
文件大?。?/td> 0K
描述： IC CLK GENERATOR PLL 32VFQFN
標準包裝： 490
類型： 時鐘/頻率發(fā)生器，扇出緩沖器（分配），多路復用器
PLL： 是
主要目的： Cavium 處理器
輸入： LVCMOS，LVDS，LVPECL，LVTTL，SSTL，晶體
輸出： LVCMOS，LVPECL，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 2:7
差分 - 輸入:輸出： 是/是
頻率 - 最大： 133.33MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤
供應商設備封裝： 32-VFQFN（5x5）
包裝： 托盤
ICS8430S07AKI REVISION A SEPTEMBER 3, 2009
10
2009 Integrated Device Technology, Inc.
ICS8430S07I Data Sheet
CLOCK GENERATOR FOR CAVIUM PROCESSORS
Parameter Measurement Information
3.3V Core/3.3V LVPECL Output Load AC Test Circuit
3.3V Core/2.5V LVCMOS Output Load AC Test Circuit
Half Period Jitter
3.3V Core/3.3V LVCMOS Output Load AC Test Circuit
Differential Input Level
Period Jitter
SCOPE
Qx
nQx
LVPECL
V
EE
2V
-1.3V±0.165V
VDDA
2V
VDD
-
SCOPE
Qx
GND
LVCMOS
-1.25V±5%
VDDO_X
2.05V±5%
1.25V±5%
VDD
VDDA
2.05V±5%
t half period n
t half period n + 1
1
f
o
t jit(hper) = t half period n — 1
2*f
o
QA
nQA
SCOPE
Qx
LVCMOS
GND
-1.65V±5%
VDDO_X
1.65V±5%
VDD,
VDDA
1.65V±5%
nCLK
CLK
VDD
GND
V
CMR
Cross Points
V
PP
VOH
VREF
VOL
Mean Period
(First edge after trigger)
10,000 cycles
Reference Point
(Trigger Edge)
Histogram
tjit (pk-pk)
相關PDF資料
PDF描述
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參數(shù)描述
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