參數(shù)資料
型號(hào)： ICS7973DI147
英文描述： LOW SKEW, 1-TO-12 LVCMOS / LVTTL CLOCK MULTIPLIER/ZERO DELAY BUFFER
中文描述： 低偏移，1至12個(gè)LVCMOS / LVTTL時(shí)鐘倍頻/零延遲緩沖器
文件頁(yè)數(shù)： 13/16頁(yè)
文件大?。?/td> 287K
代理商： ICS7973DI147
87973DYI-147
www.icst.com/products/hiperclocks.html
13
REV. A AUGUST 26, 2003
Integrated
Circuit
Systems, Inc.
ICS87973I-147
L
OW
S
KEW
, 1-
TO
-12
LVCMOS / LVTTL C
LOCK
M
ULTIPLIER
/Z
ERO
D
ELAY
B
UFFER
S
CHEMATIC
E
XAMPLE
Figure 6 shows a schematic example of using ICS87973I-147.
This example shows general design of input, output termination,
logic control input pull up/down and power supply filtering. In
this example, the clock input is driven by an LVCMOS driver.
C8
0.1uF
R3
43
C3
0.1uF
RS
Zo = 50
C11
0.01u
RD1
Not Install
C16
10u
(U1-45)
VDD
C7
0.1uF
RU2
Not Install
VDD
C9
0.1uF
R5
1K
(U1-28)
VDD=3.3V
C6
0.1uF
VDD
(U1-37)
R6
1K
R2
43
Serial Clcok
To Logic
Input
pins
Zo = 50
Set Logic
Input to
'0'
R1
43
To Logic
Input
pins
VDD
R10
1K
C5
0.1uF
R9
1K
(U1-22)
(U1-49)
(U1-33)
Zo = 50
Set Logic
Input to
'1'
U1
ICS87973I-147
1
2
3
4
5
6
7
8
9
10
11
12
13
1
1
1
1
1
1
2
2
2
2
2
2
2
39
38
37
36
35
34
33
32
31
30
29
28
27
5
5
5
4
4
4
4
4
4
4
4
4
4
GNDI
nMR/OE
FSEL_FB2
PLL_SEL
REF_SEL
CLK_SEL
nCLK
VDDA
I
G
Q
V
Q
F
F
Q
V
Q
G
Q
F
GNDO
VQB1
GNDO
QB2
VDDO
GNDO
QFB
VDD
FSEL_FB0
V
G
Q
V
Q
G
Q
V
Q
F
F
F
F
VDD
VDD
Logic Input Pin Examples
RD2
1K
R7
10 - 15
(U1-17)
RU1
1K
R8
1K
Serial Data
Zo = 50
R4
1K
C4
0.1uF
LVCMOS CLOCK
VDD
F
IGURE
6. ICS87973I-147 S
CHEMATIC
E
XAMPLE
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PDF描述
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