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參數(shù)資料
| 型號： | ICS270PG |
| 英文描述： | Triple PLL Field Programmable VCXO Clock Synthesizer |
| 中文描述： | 三鎖相環(huán)現(xiàn)場可編程VCXO的時鐘合成器 |
| 文件頁數(shù)： | 6/8頁 |
| 文件大小： | 162K |
| 代理商： | ICS270PG |
Triple PLL Field Programmable VCXO Clock
MDS 270 B
6
Revision 040705
Integrated Circuit Systems, Inc.
●
525 Race Street, San Jose, CA 95126
●
tel (408) 297-1201
●
www.icst.com
ICS270
PRELIMINARY INFORMATION
Note 1: Example with 25 MHz crystal input with eight outputs of 33.3 MHz, no load, and VDD = 3.3 V.
AC Electrical Characteristics
Unless stated otherwise,
VDD = 3.3 V ±5%
, Ambient Temperature -40 to +85
°
C
Parameter
Symbol
Input Frequency
F
IN
Output Frequency
Crystal Pullability
F
P
VCXO Gain
Note 1: External crystal device must conform with Pullable Crystal Specifications listed on page 3.
Note 2: Measured with 15 pF load.
Note 3: Duty Cycle is configuration dependent. Most configurations are min 45% / max 55%.
Thermal Characteristics
Internal Pull-up Resistor
Internal Pull-down Resistor
Input Capacitance
R
PUS
R
PD
C
IN
S2:S0, PDTS
CLK outputs
Inputs
190
220
4
k
k
pF
Conditions
Fundamental crystal
Min.
5
0.314
100
Typ.
Max.
27
200
Units
MHz
MHz
ppm
ppm/V
0V< VIN < 3.3 V, Note 1
VIN = VDD/2 + 1 V,
Note 1
80% to 20%, high drive,
Note 2
80% to 20%, low drive,
Note 2
Note 3
PLL lock-time from
power-up
PDTS goes high until
stable CLK output
Configuration Dependent
Deviation from Mean,
Configuration Dependent
Low Skew Outputs
110
Output Rise/Fall Time
t
OF
1.0
ns
Output Rise/Fall Time
t
OF
2.0
ns
Duty Cycle
40
49-51
4
60
10
%
ms
Power-up time
0.6
2
ms
One Sigma Clock Period Jitter
Maximum Absolute Jitter
50
ps
ps
t
ja
+200
Pin-to-Pin Skew
-250
250
ps
Parameter
Symbol
θ
JA
θ
JA
θ
JA
θ
JC
Conditions
Still air
1 m/s air flow
3 m/s air flow
Min.
Typ.
93
78
65
20
Max.
Units
°
C/W
°
C/W
°
C/W
°
C/W
Thermal Resistance Junction to
Ambient
Thermal Resistance Junction to Case
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
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PDF描述 |
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參數(shù)描述 |
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