參數(shù)資料
型號: ICS1524M
英文描述: Dual Output Phase Controlled SSTL-3/PECL Clock Generator
中文描述: 雙輸出相控SSTL-3/PECL時鐘發(fā)生器
文件頁數(shù): 17/24頁
文件大?。?/td> 394K
代理商: ICS1524M
17
ICS1524
ICS1524 Rev C 01/31/2003
Absolute Maximum Ratings
VDD, VDDA, VDDQ (measured to VSS) . . . . . . . . . . . . . . . . . . 4.3 V
Digital Inputs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . VSS
0.3 V to 5.5 V
Analog Outputs. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . VSSA
0.3 V to VDDA
+
0.3 V
Digital Outputs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . VSSQ
0.3 V to VDDQ
+
0.3 V
Storage Temperature . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
65
°
C to
+
150
°
C
Junction Temperature . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 175
°
C
Soldering Temperature . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 260
°
C
ESD Susceptibility* . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . > 2 KV
(*Electrostatic-sensitive devices. Do not open or handle except in a static-free workstation.)
Power Supply Considerations
The
ICS1524 incorporates special internal power-on reset circuitry that requires no external reset signal connection. The sup-
ply voltage (VDD) must remain within the recommended operating conditions during normal operation. To reset the ICS1524,
the supply voltage at the part must be reduced below the threshold voltage (V
th
) of the power-on reset circuit. The supply volt-
age must remain below that threshold voltage such that board power conditioning capacitors are drained and the proper reset
state is latched. The amount of time (t
d
) to hold the voltage in a reset state varies with the design. However, a typical value of
10 ms should be sufficient.
Supply
Voltage
t
d
V = 1.8V
th
V
min
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