參數(shù)資料
型號(hào)： ICS1524
英文描述： Dual Output Phase Controlled SSTL-3/PECL Clock Generator
中文描述： 雙輸出相控SSTL-3/PECL時(shí)鐘發(fā)生器
文件頁數(shù)： 20/24頁
文件大?。?/td> 394K
代理商： ICS1524
ICS1524
20
ICS1524 Rev C 01/31/2003
DPA Delay-16 Element Resolution
0
2
4
6
8
10
12
14
16
18
20
0
4
8
12
DPA Setting
n
50 MHz - SVGA @ 72 Hz
157.5 MHz - SXGA @ 85 Hz
DPA Delay - 32 Element Resolution
0
5
10
15
20
25
30
35
40
45
0
4
8
12
16
20
24
28
DPA Setting
n
25.175 MHz - VGA @ 60 Hz
78.75 MHz - XGA @ 75 Hz
16
DPA Delay - 64 Element Resolution
0
10
20
30
40
50
60
70
80
90
0
4
8
12
16
20
24
28
32
36
40
44
48
52
56
60
DPA Setting
n
12.27 MHz - NTSC
39.8 MHz - SVGA @ 60
32
64
Note:
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PDF描述
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ICS1524M 制造商:ICS 制造商全稱:ICS 功能描述:Dual Output Phase Controlled SSTL-3/PECL Clock Generator
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