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參數(shù)資料
| 型號： | HYS72D16000GR-8-A |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | Registered DDR SDRAM-Modules |
| 中文描述： | 注冊DDR SDRAM內(nèi)存模塊 |
| 文件頁數(shù)： | 8/28頁 |
| 文件大?。?/td> | 676K |
| 代理商： | HYS72D16000GR-8-A |
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I/O Driver power supply
V
DD
Indentification flag
EEPROM power supply
I/O reference supply
Serial bus clock
Serial bus data line
slave address select
no connect
don’t use
Reset pin (forces register inputs low) *)
HYS72D[16000/32001]GR-[7/8]-A
Registered DDR SDRAM Modules
Pin Configuration
Data Sheet
8
Rev. 1.04, 2004-01
10282003-ROLI-0GQ8
2
Pin Configuration
*) for detailed description of the Power Up and Power Management on DDR Registered DIMMs see the Application Note at the
end of this datasheet
Table 3
Symbol
A0 – A11
BA0, BA1
DQ0 – DQ63
CB0 – CB7
RAS
CAS
WE
CKE0, CKE1
DQS0 – DQS8
CK0, CK0
DM0 – DM8
DQS9 – DQS17
CS0, CS1
V
DD
V
SS
V
DDQ
V
DDID
V
DDSPD
V
REF
SCL
SDA
SA0 – SA2
NC
DU
RESET
Pin Definitions and Functions
Type
Input
Input
Input/Output
Input/Output
Input
Input
Input
Input
Input/Output
Input
Input
Input/Output
Input
Supply
Supply
Supply
Output
Supply
Supply
Input
Output
Input
Input
Input
Input
Function
Address Inputs
Rank Selects
Data Input/Output
Check Bits (
×
72 organization only)
Row Address Strobe
Column Address Strobe
Read/Write Input
Clock Enable
SDRAM low data strobes
Differential Clock Input
SDRAM low data mask
high data strobes
Chip Selects
Power (+2.5 V)
Ground
Table 4
Density
Address Format
Organization
Memory
Ranks
SDRAMs
# of
SDRAMs
# of
row/rank/
columns
bits
12/2/10
12/2/11
Refresh
Period Interval
128 MB
256 MB
16M
×
72
32M
×
72
1
1
16M
×
8
32M
×
4
9
18
4K
4K
64 ms
64 ms
15.6
μ
s
15.6
μ
s
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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| HYS72D16500GR-7-A | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:Low Profile DDR SDRAM-Modules |
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