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參數(shù)資料
| 型號： | HYS72D128521GR-7-B |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | Connector Wall Plate; Color:Electric White; Leaded Process Compatible:Yes; No. of Ports:4 RoHS Compliant: Yes |
| 中文描述： | 注冊DDR SDRAM內存模塊 |
| 文件頁數(shù)： | 12/39頁 |
| 文件大?。?/td> | 1036K |
| 代理商： | HYS72D128521GR-7-B |
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HYS72D[128/64/32]5[00/20/21]GR–[7F/7/8]-B
Registered DDR SDRAM-Modules
Pin Configuration
Data Sheet
12
Rev. 1.03 2004-01
Figure 2
Block Diagram: One Rank 64M
×
72 DDR SDRAM DIMM Module (
×
4 components)
HYS72D64500GR on Raw Card M
RS0
DQS0
DQS4
DQS6
DQS2
DQ0
DQ1
DQ2
DQ3
DQ8
DQ9
DQ10
DQ11
DQ16
DQ17
DQ18
DQ19
DQ24
DQ25
DQ26
DQ27
DQ32
DQ33
DQ34
DQ35
DQ40
DQ41
DQ42
DQ43
DQ56
DQ57
DQ58
DQ59
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D0
DQS
I/O 0
I/O 1
I/O 2
I/O 3
DQS
I/O 0
I/O 1
I/O 2
I/O 3
DQS
I/O 0
I/O 1
I/O 2
I/O 3
DQS
I/O 0
I/O 1
I/O 2
I/O 3
DQS
I/O 0
I/O 1
I/O 2
I/O 3
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D1
D2
D3
D4
D5
D7
DQ48
DQ49
DQ50
DQ51
DQS
D6
DQ4
DQ5
DQ6
DQ7
DQ12
DQ13
DQ14
DQ15
DQ20
DQ21
DQ22
DQ23
DQ28
DQ29
DQ30
DQ31
DQ36
DQ37
DQ38
DQ39
DQ44
DQ45
DQ46
DQ47
DQ60
DQ61
DQ62
DQ63
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D9
DQS
I/O 0
I/O 1
I/O 2
I/O 3
DQS
I/O 0
I/O 1
I/O 2
I/O 3
DQS
I/O 0
I/O 1
I/O 2
I/O 3
DQS
I/O 0
I/O 1
I/O 2
I/O 3
DQS
I/O 0
I/O 1
I/O 2
I/O 3
DQS
I/O 0
I/O 1
I/O 2
I/O 3
DQS9
D10
D11
D12
D13
D14
D16
DQ52
DQ53
DQ54
DQ55
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D15
CB0
CB1
CB2
CB3
DQS
D8
CB4
CB5
CB6
CB7
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D17
S
S
S
S
S
S
S
S
S
S
S
S
S
S
S
S
S
S
VSS
DQS1
DQS3
DQS8
DM
DM
DM
DM
DM
DM
DM
DM
DM
DM
DM
DM
DM
DM
DM
DM
DM
DM
DQS5
DQS7
DQS15
DQS14
DQS13
DQS10
DQS11
DQS12
DQS16
DQS17
Notes:
1. DQ-to-I/O wiring may be changed
within a byte.
2. DQ/DQS/CKE/S relationships
must be maintained as shown.
3. DQ/DQS resistors should be 22
Ohms.
4. V
DDID
strap connections
(for memory device V
DD
, V
DDQ
):
STRAP OUT (OPEN): V
DD
= V
DDQ
STRAP IN (V
SS
): V
DD
≠
V
DDQ
.
5. Address and control resistors
should be 22 Ohms.
6. A13 is not wired for raw card B.
V
DD
V
SS
D0-D17
D0-D17
V
DDQ
D0-D17
D0-D17
VREF
V
DDID
Strap: see Note 4
CK0, CK0 --------- PLL*
* Wire per Clock Loading Table/Wiring Diagrams
BA0-BA1
A0-A
n
6
RAS
CAS
CKE0
WE
RBA0-RBA1 -> BA0-BA1: SDRAMs D0-D17
RA0-RA
n
6
-> A0-A
n
6
: SDRAMs D0-D17
RRAS -> RAS: SDRAMs D0-D17
RCAS -> CAS: SDRAMs D0-D17
RCKE0A -> CKE: SDRAMs D0-D17
RWE -> WE: SDRAMs D0-D17
S0
RS0 -> CS : SDRAMs D0-D17
R
E
G
I
S
T
E
R
PCK
PCK
RESET
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
V
DDSPD
Serial PD
A0
Serial PD
A1
A2
SA0 SA1 SA2
SDA
SCL
WP
相關PDF資料 |
PDF描述 |
|---|---|
| HYS72D32500GR-8-B | Registered DDR SDRAM-Modules |
| HYS72D64500GR-8-B | Registered DDR SDRAM-Modules |
| HYS72T128020HU-37-A | 240-Pin Unbuffered DDR2 SDRAM Modules |
| HYS64T128020HU-37-A | 240-Pin Unbuffered DDR2 SDRAM Modules |
| HYS64T64000HU-37-A | 240-Pin Unbuffered DDR2 SDRAM Modules |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| HYS72D128521GR-7F-B | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:Low Profile Registered DDR-I SDRAM-Modules |
| HYS72D128521GR-8-B | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:Low Profile Registered DDR-I SDRAM-Modules |
| HYS72D128900HBR-6-C | 制造商:QIMONDA 制造商全稱:QIMONDA 功能描述:184-Pin Registered Double-Data-Rate SDRAM Module |
| HYS72D16000GR | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:Registered DDR SDRAM-Modules |
| HYS72D16000GR-7-A | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:Registered DDR SDRAM-Modules |
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