參數(shù)資料
型號: HYS 64V4300GU
廠商: SIEMENS AG
英文描述: 3.3 V 4M × 64-Bit 1 Bank SDRAM Module(3.3 V 4M × 64-位 × 1列同步動態(tài)RAM模塊)
中文描述: 3.3伏4米× 64位一銀行內(nèi)存模塊(3.3伏分× 64 -位× 1列同步動態(tài)內(nèi)存模塊)
文件頁數(shù): 10/12頁
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代理商: HYS 64V4300GU
HYS 64V4300GU
SDRAM-Modules
Data Book
10
12.99
SPD-Table
Byte#
Description
SPD Entry Value
Hex
4M
×
64
-7.5
4M
×
64
-8
0
Number of SPD bytes
128
80
80
1
Total Bytes in Serial PD
256
08
08
2
Memory Type
SDRAM
04
04
3
Number of Row Addresses (without BS bits)
12
0C
0C
4
Number of Column Addresses
8
08
08
5
Number of DIMM Banks
1
01
01
6
Module Data Width
64
40
40
7
Module Data Width (cont’d)
0
00
00
8
Module Interface Levels
LVTTL
01
01
9
SDRAM Cycle Time at CL = 3
7.5/10.0 ns
75
A0
10
SDRAM Access Time from Clock at CL = 3
5.4/6.0 ns
54
60
11
DIMM Config (Error Det/Corr.)
none
Self-Refresh, 15.6
μ
s
x16
00
00
12
Refresh Rate/Type
80
80
13
SDRAM Width, Primary
10
10
14
Error Checking SDRAM Data Width
n/a
t
CCD
= 1 CLK
00
00
15
Minimum Clock Delay for Back-to-Back
Random Column Address
01
01
16
Burst Length Supported
1, 2, 4, 8 & full page
8F
8F
17
Number of SDRAM Banks
4
04
04
18
Supported CAS Latencies
CL = 2 & 3
06
06
19
CS Latencies
CS latency = 0
01
01
20
WE Latencies
WL = 0
01
01
21
SDRAM DIMM Module Attributes
non buffered/non reg.
V
DD
tol.
±
10%
00
00
22
SDRAM Device Attributes: General
0E
0E
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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