參數(shù)資料
型號(hào)： HEF4011UBP
廠商： NXP Semiconductors N.V.
元件分類： 通用總線功能
英文描述： Quadruple 2-input NAND gate
封裝： HEF4011UBP<SOT27-1 (DIP14)|<<http://www.nxp.com/packages/SOT27-1.html<1<Always Pb-free,;HEF4011UBT<SOT108-1 (SO14)|<<http://www.nxp.com/packages/SOT108-1.html<1<wee
文件頁數(shù)： 3/8頁
文件大?。?/td> 133K
代理商： HEF4011UBP
January 1995
3
Philips Semiconductors
Product specification
Quadruple 2-input NAND gate
HEF4011UB
gates
AC CHARACTERISTICS
V
SS
= 0 V; T
amb
= 25
°
C; C
L
= 50 pF; input transition times
≤
20 ns
V
DD
V
SYMBOL
TYP.
MAX.
TYPICAL EXTRAPOLATION
FORMULA
Propagation delays
I
n
→
O
n
HIGH to LOW
5
60
25
20
35
20
17
75
30
20
60
30
20
120
50
40
70
40
35
150
60
40
110
60
40
10
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
pF
25 ns
+
(0,70 ns/pF) C
L
12 ns
+
(0,27 ns/pF) C
L
10 ns
+
(0,20 ns/pF) C
L
8 ns
+
(0,55 ns/pF) C
L
9 ns
+
(0,23 ns/pF) C
L
9 ns
+
(0,16 ns/pF) C
L
15 ns
+
(1,20 ns/pF) C
L
6 ns
+
(0,48 ns/pF) C
L
4 ns
+
(0,32 ns/pF) C
L
10 ns
+
(1,00 ns/pF) C
L
9 ns
+
(0,42 ns/pF) C
L
6 ns
+
(0,28 ns/pF) C
L
10
15
t
PHL
5
LOW to HIGH
10
15
t
PLH
Output transition
times
HIGH to LOW
5
10
15
t
THL
5
LOW to HIGH
10
15
t
TLH
Input capacitance
C
IN
V
DD
V
TYPICAL FORMULA FOR P (
μ
W)
Dynamic power
dissipation per
package (P)
5
500 f
i
+ ∑
(f
o
C
L
)
×
V
DD2
5 000 f
i
+ ∑
(f
o
C
L
)
×
V
DD2
25 000 f
i
+ ∑
(f
o
C
L
)
×
V
DD2
where
f
i
= input freq. (MHz)
f
o
= output freq. (MHz)
C
L
= load capacitance (pF)
∑
(f
o
C
L
) = sum of outputs
V
DD
= supply voltage (V)
10
15
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參數(shù)描述
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HEF4011UBP 制造商:NXP Semiconductors 功能描述:IC 4000 LOCMOS 4011 DIP14 15V
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HEF4011UBT 制造商:NXP Semiconductors 功能描述:HEF4000 NAND Bulk
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