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參數(shù)資料
| 型號： | HD6435328F |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | Manual Gives a Hardware Description |
| 中文描述： | 手冊給出硬件描述 |
| 文件頁數(shù)： | 203/459頁 |
| 文件大小： | 1032K |
| 代理商： | HD6435328F |
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Bit 7
ICF
0
Description
This bit is cleared from 1 to 0 when: (Initial value)
1. The CPU reads the ICF bit, then writes a “0” in this bit.
2. The data transfer controller (DTC) serves an input capture interrupt.
This bit is set to 1 when an input capture signal causes the FRC value to be copied to the ICR.
1
Bit 6—Output Compare Flag B (OCFB):
This status flag is set to “1” when the FRC value
matches the OCRB value.
Bit 6
OCFB
0
Description
This bit is cleared from 1 to 0 when: (Initial value)
1. The CPU reads the OCFB bit, then writes a “0” in this bit.
2. The data transfer controller (DTC) serves output compare interrupt B.
This bit is set to 1 when FRC = OCRB.
1
Bit 5—Output Compare Flag A (OCFA):
This status flag is set to “1” when the FRC value
matches the OCRA value.
Bit 5
OCFA
0
Description
This bit is cleared from 1 to 0 when: (Initial value)
1. The CPU reads the OCFA bit, then writes a “0” in this bit.
2. The data transfer controller (DTC) serves output compare interrupt A.
This bit is set to 1 when FRC = OCRA.
1
Bit 4—Timer Overflow Flag (OVF):
This status flag is set to “1” when the FRC overflows
(changes from H'FFFF to H'0000).
Bit 4
OVF
0
Description
This bit is cleared from 1 to 0 when the CPU reads (Initial value)
the OVF bit, then writes a “0” in this bit.
This bit is set to 1 when FRC changes from H'FFFF to H'0000.
1
Bit 3—Output Level B (OLVLB):
This bit selects the logic level to be output at the FTOB pin
when the FRC and OCRB values match.
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