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參數(shù)資料
| 型號： | GPTRM |
| 英文描述： | General-Purpose Timer Reference Manual |
| 中文描述： | 通用定時器參考手冊 |
| 文件頁數(shù)： | 27/90頁 |
| 文件大?。?/td> | 647K |
| 代理商： | GPTRM |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁當(dāng)前第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁
GPT
REFERENCE MANUAL
COMPARE/CAPTURE UNIT
MOTOROLA
3-5
Figure 3-3 Input Capture Register 1–3 (TIC1–3)
3.2.2 Input Capture 4/Output Compare 5 Register (TI4/O5)
Input capture 4/output compare 5 (TI4/O5) serves as either an input capture register
or as an output compare register depending on the function chosen for the I4/O5 pin.
Refer to
Figure 3-4
. To make this pin serve as an input capture pin, the I4/O5 bit in
the pulse accumulator control register (PACTL) must be set to a logic level one. Set
the bit to a logic level zero for the pin to be used as output compare. Refer to
4.1.1
Pulse Accumulator Register/Pulse Accumulator Counter (PACTL/PACNT)
. TI4/
O5 is reset to $FFFF.
Figure 3-4 Input Capture 4/Output Compare 5 Register (TI4/O5)
3.2.3 Timer Control Register 2 (TCTL2)
TCTL2 is used to select the edge to which the input capture logic will respond.
Table
3-1
shows that the input capture logic can be disabled, an input capture can occur on
a rising edge, a falling edge, or any edge. Refer to
Figure 3-5
.
* These bits are part of TCTL1.
NOTE: The address shown is on a word boundary; however, the register can be accessed by a word or byte ad-
dress ($YFF91F) cycle.
Figure 3-5 Timer Control Register 2 (TCTL2)
TIC1–TIC3 —
Input Capture Registers 1–3
$YFF90E, $YFF910, $YFF912
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RESET:
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
TI4/O5 —
Input Capture 4/Output Compare 5 Register
$YFF91C
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RESET:
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
TCTL2 —
Timer Control Register 2
$YFF91E
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
*
*
*
*
*
*
*
*
EDGE4B EDGE4A EDGE3B EDGE3A EDGE2B EDGE2A EDGE1B EDGE1A
RESET:
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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