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參數(shù)資料
| 型號： | GMS81524BK |
| 廠商： | Hynix Semiconductor Inc. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-BIT SINGLE-CHIP MICROCONTROLLERS |
| 中文描述： | 8位單晶片微控制器 |
| 文件頁數(shù)： | 58/110頁 |
| 文件大?。?/td> | 1980K |
| 代理商： | GMS81524BK |
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GMS81508B/16B/24B, GMS82512/16/24
MAY. 2001 Ver 2.0
55
14. PWM OUTPUT
- This function is NOT served on the GMS825xx.
The GMS815xxB have two channels of built-in pulse
width modulation outputs. PWM outputs data are multi-
plex to the R56 and R57 port. Bit 6 and bit 7 of R5DD
should be set to “1” when PWM is used as an output port.
The input clock is selected by PWM Control Register
(PWMCR, address F2
H
) and the width of pulse is deter-
mined by the PWM Register (PWMR, address F0
H
and
F1
H
).
Figure 14-1 PWM block diagram
The pulse period according to input clock are shown as be-
low.
Bit 2 (EN0) and bit 3 (EN1) of PWMCR determine the op-
eration channel of PWM. When EN0=0 and EN1=0, PWM
does not execute
It is a PWM output controlled by PWMCR, PWMR0 and
PWMR1.
f
XIN
÷
256
f
XIN
÷
512
f
XIN
÷
1024
f
XIN
÷
2048
MUX
S
P0CK[1:0]
00
01
10
11
PWM0
Comparator
8-bit Counter
R
PWMR0
Q
Overflow
f
XIN
÷
2048
MUX
S
P1CK[1:0]
11
10
01
00
Comparator
8-bit Counter
f
XIN
÷
1024
f
XIN
÷
512
f
XIN
÷
256
R
PWMR1
Q
Overflow
POL0
PWM1
POL1
EN0
EN1
0
1
0
1
F/F
F/F
[0F0
H
]
[0F1
H
]
Input clock
Period of PWM
f
XIN
÷
256
f
XIN
÷
512
f
XIN
÷
1024
f
XIN
÷
2048
8.19 ms
16.38 ms
32.77 ms
65.54 ms
Duty ratio
---------------------------
1
+
256
100%
×
=
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PDF描述 |
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