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參數(shù)資料
| 型號(hào)： | FMS6501MSA28X |
| 廠商： | Fairchild Semiconductor |
| 文件頁(yè)數(shù)： | 12/14頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC VIDEO SW MATRIX 12X9 28SSOP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 視頻開(kāi)關(guān)，12 輸入，9 輸出 |
| 應(yīng)用： | 機(jī)頂盒 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-SSOP（0.209"，5.30mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 28-SSOP |
| 包裝： | 標(biāo)準(zhǔn)包裝 |
| 產(chǎn)品目錄頁(yè)面： | 1214 (CN2011-ZH PDF) |
| 其它名稱： | FMS6501MSA28XDKR |
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FMS6501
—
12
Input
/
9
Output
V
ideo
Switch
Matrix
with
I
nput
Clamp,
Input
Bias
Circ
uitry
,and
Output
Drivers
2004 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FMS6501 Rev. 1.0.4
7
I2C BUS Characteristics
TA = 25°C and VCC = 5V unless otherwise noted.
Notes:
1. 100% tested at 25°C.
Figure 3. I2C Bus Timing
Symbol
Parameter
Conditions
Min.
Typ.
Max
Units
Vil
Digital Input Low(1)
SDA, SCL, ADDR
0
1.5
V
Vih
Digital Input High(1)
SDA, SCL, ADDR
3.0
Vcc
V
fscl
Clock Frequency
SCK
100
kHz
tr
Input Rise Time
1.5V to 3V
1000
ns
tf
Input Fall Time
1.5V to 3V
300
ns
tlow
Clock Low Period
4.7
s
thigh
Clock High Period
4.0
s
tSU,DAT
Data Set-up Time
300
ns
tHD,DAT
Data Hold Time
0
ns
tSU,STO
Set-up Time from Clock High to Stop
4
s
tBUF
Start Set-up Time Following a Stop
4.7
s
tHD,STA
Start Hold Time
4
s
tSU,STA
Start Set-up Time Following Clock Low to High
4.7
s
SDA
SCL
SDA
tBUF
tLOW
tf
tHD,STA
tr
tHD,DAT tHIGH
tSU,DAT
tSU,STO
tSU,STA
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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