Revision 10 1-27 eX Family Timing Characteristics Table 1-17 eX Family Timing Characteristics (Worst-Case" />
參數(shù)資料
型號(hào)： EX128-TQG64A
廠商： Microsemi SoC
文件頁(yè)數(shù)： 25/48頁(yè)
文件大?。?/td> 0K
描述： IC FPGA ANTIFUSE 6K 64-TQFP
標(biāo)準(zhǔn)包裝： 160
系列： EX
邏輯元件/單元數(shù)： 256
輸入/輸出數(shù)： 46
門(mén)數(shù)： 6000
電源電壓： 2.3 V ~ 2.7 V
安裝類(lèi)型： 表面貼裝
工作溫度： -40°C ~ 125°C
封裝/外殼： 64-LQFP
供應(yīng)商設(shè)備封裝： 64-TQFP（10x10）
eX Family FPGAs
Revision 10
1-27
eX Family Timing Characteristics
Table 1-17 eX Family Timing Characteristics
(Worst-Case Commercial Conditions, VCCA = 2.3 V, TJ = 70C)
–P Speed
Std Speed
–F Speed
Units
Parameter
Description
Min.
Max.
Min.
Max.
Min.
Max.
C-Cell Propagation Delays1
tPD
Internal Array Module
0.7
1.0
1.4
ns
Predicted Routing Delays2
tDC
FO=1 Routing Delay, DirectConnect
0.1
0.2
ns
tFC
FO=1 Routing Delay, FastConnect
0.3
0.5
0.7
ns
tRD1
FO=1 Routing Delay
0.3
0.5
0.7
ns
tRD2
FO=2 Routing Delay
0.4
0.6
0.8
ns
tRD3
FO=3 Routing Delay
0.5
0.8
1.1
ns
tRD4
FO=4 Routing Delay
0.7
1.0
1.3
ns
tRD8
FO=8 Routing Delay
1.2
1.7
2.4
ns
tRD12
FO=12 Routing Delay
1.7
2.5
3.5
ns
R-Cell Timing
tRCO
Sequential Clock-to-Q
0.6
0.9
1.3
ns
tCLR
Asynchronous Clear-to-Q
0.6
0.8
1.2
ns
tPRESET
Asynchronous Preset-to-Q
0.7
0.9
1.3
ns
tSUD
Flip-Flop Data Input Set-Up
0.5
0.7
1.0
ns
tHD
Flip-Flop Data Input Hold
0.0
ns
tWASYN
Asynchronous Pulse Width
1.3
1.9
2.6
ns
tRECASYN
Asynchronous Recovery Time
0.3
0.5
0.7
ns
tHASYN
Asynchronous Hold Time
0.3
0.5
0.7
ns
2.5 V Input Module Propagation Delays
tINYH
Input Data Pad-to-Y HIGH
0.6
0.9
1.3
ns
tINYL
Input Data Pad-to-Y LOW
0.8
1.1
1.5
ns
3.3 V Input Module Propagation Delays
tINYH
Input Data Pad-to-Y HIGH
0.7
1.0
1.4
ns
tINYL
Input Data Pad-to-Y LOW
0.9
1.3
1.8
ns
5.0 V Input Module Propagation Delays
tINYH
Input Data Pad-to-Y HIGH
0.7
1.0
1.4
ns
tINYL
Input Data Pad-to-Y LOW
0.9
1.3
1.8
ns
Input Module Predicted Routing Delays2
tIRD1
FO=1 Routing Delay
0.3
0.4
0.5
ns
tIRD2
FO=2 Routing Delay
0.4
0.6
0.8
ns
tIRD3
FO=3 Routing Delay
0.5
0.8
1.1
ns
tIRD4
FO=4 Routing Delay
0.7
1.0
1.3
ns
tIRD8
FO=8 Routing Delay
1.2
1.7
2.4
ns
tIRD12
FO=12 Routing Delay
1.7
2.5
3.5
ns
Notes:
1. For dual-module macros, use tPD + tRD1 + tPDn, tRCO + tRD1 + tPDn or tPD1 + tRD1 + tSUD, whichever is appropriate.
2. Routing delays are for typical designs across worst-case operating conditions. These parameters should be used for
estimating device performance.
Post-route timing analysis or simulation is required to determine actual worst-case
performance.
相關(guān)PDF資料
PDF描述
ABC60DRTH-S13 CONN EDGECARD 120PS DIP .100 SLD
RMC10DTEF CONN EDGECARD 20POS .100 EYELET
ACC65DREF CONN EDGECARD 130PS .100 EYELET
ABC65DREF CONN EDGECARD 130PS .100 EYELET
ACB35DHAR CONN EDGECARD 70POS R/A .050 DIP
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參數(shù)描述
EX128-TQG64I 功能描述:IC FPGA ANTIFUSE 6K 64-TQFP RoHS:是 類(lèi)別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列） 系列:EX 標(biāo)準(zhǔn)包裝:152 系列:IGLOO PLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):792 RAM 位總計(jì):- 輸入/輸出數(shù):120 門(mén)數(shù):30000 電源電壓:1.14 V ~ 1.575 V 安裝類(lèi)型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA，CSBGA 供應(yīng)商設(shè)備封裝:289-CSP（14x14）
EX12BTQ64I 制造商:ACTEL 功能描述:New
EX12L-120PC/3E-GL/L 制造商:Hirose 功能描述:
EX12L-120PC/3E-GL/L(50) 功能描述:集管和線殼 HIROSE ELECTRIC RoHS:否 產(chǎn)品種類(lèi):1.0MM Rectangular Connectors 產(chǎn)品類(lèi)型:Headers - Pin Strip 系列:DF50 觸點(diǎn)類(lèi)型:Pin (Male) 節(jié)距:1 mm 位置/觸點(diǎn)數(shù)量:16 排數(shù):1 安裝風(fēng)格:SMD/SMT 安裝角:Right 端接類(lèi)型:Solder 外殼材料:Liquid Crystal Polymer (LCP) 觸點(diǎn)材料:Brass 觸點(diǎn)電鍍:Gold 制造商:Hirose Connector
EX12L-120PC/3E-GL/L(51) 功能描述:集管和線殼 HIROSE ELECTRIC RoHS:否 產(chǎn)品種類(lèi):1.0MM Rectangular Connectors 產(chǎn)品類(lèi)型:Headers - Pin Strip 系列:DF50 觸點(diǎn)類(lèi)型:Pin (Male) 節(jié)距:1 mm 位置/觸點(diǎn)數(shù)量:16 排數(shù):1 安裝風(fēng)格:SMD/SMT 安裝角:Right 端接類(lèi)型:Solder 外殼材料:Liquid Crystal Polymer (LCP) 觸點(diǎn)材料:Brass 觸點(diǎn)電鍍:Gold 制造商:Hirose Connector
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