參數(shù)資料
型號(hào)： EVAL-ADUC7121QSPZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 24/96頁(yè)
文件大小： 0K
描述： BOARD EVALUATION FOR ADUC7121
設(shè)計(jì)資源： ADUC7121 Gerber Files
ADUC7121 Schematic
標(biāo)準(zhǔn)包裝： 1
系列： MicroConverter® ADuC7xxx
類(lèi)型： MCU
適用于相關(guān)產(chǎn)品： ADUC7121
所含物品： 板，CD
ADuC7121
Data Sheet
Rev. B | Page 30 of 96
Table 29. ADCCON MMR Bit Designations (Address = 0xFFFF0500, Default Value = 0x00000A00)
Bit
Value
Description
31:16
These bits are reserved.
15
Positive ADC buffer bypass.
0
Set to 0 by the user to enable the positive ADC buffer.
1
Set to 1 by the user to bypass the positive ADC buffer.
14
Negative ADC buffer bypass.
0
Set to 0 by the user to enable the negative ADC buffer.
1
Set to 1 by the user to bypass the negative ADC buffer.
13:11
ADC clock speed.
fADC = fCORE Conversion = 19 ADC Clocks + Acquisition Time
000
fADC divide-by-1. This divider is provided to obtain a 1 MSPS ADC with an external clock of <41.78 MHz.
001
fADC divide-by-2 (default value).
010
fADC divide-by-4.
011
fADC divide-by-8.
100
fADC divide-by-16.
101
fADC divide-by-32.
10:8
ADC acquisition time (number of ADC clocks).
000
2 clocks.
001
4 clocks.
010
8 clocks (default value).
011
16 clocks.
100
32 clocks.
101
64 clocks.
7
Enable conversion.
Set by the user to 1 to enable conversion mode.
Cleared by the user to 0 to disable conversion mode.
6
Reserved. The user sets this bit to 0.
5
ADC power control.
1
Set by the user to 1 to place the ADC in normal mode. The ADC must be powered up for at least 5 μs
before it converts correctly.
0
Cleared by the user to 0 to place the ADC in power-down mode.
4:3
Conversion mode.
00
Single-ended mode.
01
Differential mode.
10
Pseudo differential mode.
11
Reserved.
2:0
Conversion type.
000
Enable the ADCCONVST function on Pin F3 as a conversion input.
001
Enable Timer1 as a conversion input.
010
Enable Timer0 as a conversion input.
011
Single software conversion. Automatically set to 000 after conversion.
100
Continuous software conversion.
101
PLA conversion.
110
PWM conversion.
Other
Reserved.
相關(guān)PDF資料
PDF描述
EVAL-ADUC7126QSPZ BOARD EVALUATION FOR ADUC7126
REC5-243.3SRWZ/H4/A CONV DC/DC 5W 9-36VIN 3.3VOUT
EVAL-ADUC7023QSPZ KIT DEV FOR ADUC7023 QUICK START
RPS-1K-6-250/2.0-9 HEAT SHRINK SLEEVE
ECM30DCWH CONN EDGECARD 60POS DIP .156 SLD
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