參數(shù)資料
型號: EPM3256AFC256-7
廠商: Altera
文件頁數(shù): 8/46頁
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描述: IC MAX 3000A CPLD 256 256-FBGA
標準包裝: 90
系列: MAX® 3000A
可編程類型: 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1): 7.5ns
電壓電源 - 內(nèi)部: 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目: 16
宏單元數(shù): 256
門數(shù): 5000
輸入/輸出數(shù): 161
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 256-BGA
供應商設備封裝: 256-FBGA(17x17)
包裝: 托盤
16
Altera Corporation
MAX 3000A Programmable Logic Device Family Data Sheet
The programming times described in Tables 4 through 6 are associated
with the worst-case method using the enhanced ISP algorithm.
Tables 5 and 6 show the in-system programming and stand alone
verification times for several common test clock frequencies.
Table 4. MAX 3000A tPULSE & CycleTCK Values
Device
Programming
Stand-Alone Verification
tPPULSE (s)
CyclePTCK
tVPULSE (s)
CycleVTCK
EPM3032A
2.00
55,000
0.002
18,000
EPM3064A
2.00
105,000
0.002
35,000
EPM3128A
2.00
205,000
0.002
68,000
EPM3256A
2.00
447,000
0.002
149,000
EPM3512A
2.00
890,000
0.002
297,000
Table 5. MAX 3000A In-System Programming Times for Different Test Clock Frequencies
Device
fTCK
Units
10 MHz
5 MHz
2 MHz
1 MHz
500 kHz
200 kHz
100 kHz
50 kHz
EPM3032A
2.01
2.03
2.06
2.11
2.28
2.55
3.10
s
EPM3064A
2.01
2.02
2.05
2.11
2.21
2.53
3.05
4.10
s
EPM3128A
2.02
2.04
2.10
2.21
2.41
3.03
4.05
6.10
s
EPM3256A
2.05
2.09
2.23
2.45
2.90
4.24
6.47
10.94
s
EPM3512A
2.09
2.18
2.45
2.89
3.78
6.45
10.90
19.80
s
Table 6. MAX 3000A Stand-Alone Verification Times for Different Test Clock Frequencies
Device
fTCK
Units
10 MHz
5 MHz
2 MHz
1 MHz
500 kHz
200 kHz
100 kHz
50 kHz
EPM3032A
0.00
0.01
0.02
0.04
0.09
0.18
0.36
s
EPM3064A
0.01
0.02
0.04
0.07
0.18
0.35
0.70
s
EPM3128A
0.01
0.02
0.04
0.07
0.14
0.34
0.68
1.36
s
EPM3256A
0.02
0.03
0.08
0.15
0.30
0.75
1.49
2.98
s
EPM3512A
0.03
0.06
0.15
0.30
0.60
1.49
2.97
5.94
s
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EPM3256AQC208-10 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 3000A 256 Macro 161 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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