參數資料
| 型號： | EP2S60F672I4 |
| 廠商： | Altera |
| 文件頁數： | 725/768頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX II FPGA 60K 672-FBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 10 |
| 系列： | Stratix® II |
| LAB/CLB數： | 3022 |
| 邏輯元件/單元數： | 60440 |
| RAM 位總計： | 2544192 |
| 輸入/輸出數： | 492 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 672-BBGA |
| 供應商設備封裝： | 672-BGA（27x27） |
| 配用： | 544-1700-ND - DSP KIT W/STRATIX II EP2S60N 544-1697-ND - NIOS II KIT W/STRATIX II EP2S60N |
| 其它名稱： | 544-1915 EP2S60F672I4-ND |
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Altera Corporation
11–15
May 2007
Stratix II Device Handbook, Volume 2
High-Speed Board Layout Guidelines
1
If possible, you should avoid using stubs in your PCB design.
For high-speed designs, even very short stubs can create signal
integrity problems.
Figure 11–14. Daisy Chain Routing with Stubs
Figures 11–15 through 11–17 show the SPICE simulation with different
stub length. As the stub length decreases, there is less reflection noise,
which causes the eye opening to increase.
Figure 11–15. Stub Length = 0.5 Inch
Figure 11–16. Stub Length = 0.25 Inch
Device 1
Device 2
Clock
Source
Main Bus
Stub
Termination
Resistor
Device Pin
(BGA Ball)
發(fā)布緊急采購，3分鐘左右您將得到回復。