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參數(shù)資料
| 型號(hào)： | EP2S130F1020C5N |
| 廠商： | Altera |
| 文件頁(yè)數(shù)： | 679/768頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX II FPGA 130K 1020FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 6 |
| 系列： | Stratix® II |
| LAB/CLB數(shù)： | 6627 |
| 邏輯元件/單元數(shù)： | 132540 |
| RAM 位總計(jì)： | 6747840 |
| 輸入/輸出數(shù)： | 742 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 1020-BBGA |
| 供應(yīng)商設(shè)備封裝： | 1020-FBGA（33x33） |
| 其它名稱： | 544-1867 EP2S130F1020C5N-ND |
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Altera Corporation
2–53
May 2007
Stratix II Device Handbook, Volume 1
Stratix II Architecture
Figure 2–36. EP2S60, EP2S90, EP2S130 & EP2S180 Device I/O Clock Groups
You can use the Quartus II software to control whether a clock input pin
drives either a global, regional, or dual-regional clock network. The
Quartus II software automatically selects the clocking resources if not
specified.
Clock Control Block
Each global clock, regional clock, and PLL external clock output has its
own clock control block. The control block has two functions:
■
Clock source selection (dynamic selection for global clocks)
■
Clock power-down (dynamic clock enable/disable)
IO_CLKJ[7:0]
IO_CLKI[7:0]
IO_CLKA[7:0]
IO_CLKB[7:0]
8
24 Clocks in the
Quadrant
24 Clocks in the
Quadrant
24 Clocks in the
Quadrant
24 Clocks in the
Quadrant
8
I/O Clock Regions
IO_CLKL[7:0]
IO_CLKK[7:0]
IO_CLKC[7:0]
IO_CLKD[7:0]
888
8
IO_CLKE[7:0]
IO_CLKF[7:0]
IO_CLKG[7:0]
IO_CLKH[7:0]
IO_CLKN[7:0]
IO_CLKM[7:0]
IO_CLKP[7:0]
IO_CLKO[7:0]
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP2S90F780I4 | IC STRATIX II FPGA 90K 780-FBGA |
| RSC50DRAI-S734 | CONN EDGECARD 100PS .100 R/A PCB |
| 180-078-271L020 | CONN DB78 FMALE HD CRIMP Y-CHROM |
| RMC50DRAI-S734 | CONN EDGECARD 100PS .100 R/A PCB |
| ABC65DRTI-S734 | CONN EDGECARD 130PS DIP .100 SLD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EP2S130F1020I4 | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II 6627 LABs 742 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S130F1020I4N | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II 6627 LABs 742 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S130F1020I4RB | 制造商:Altera Corporation 功能描述:FPGA Stratix |
| EP2S130F1020I5N | 制造商:Altera Corporation 功能描述: |
| EP2S130F1508C3 | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II 6627 LABs 1126 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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