參數資料
| 型號： | EP2S130F1020C4 |
| 廠商： | Altera |
| 文件頁數： | 315/768頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX II FPGA 130K 1020FBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 6 |
| 系列： | Stratix® II |
| LAB/CLB數： | 6627 |
| 邏輯元件/單元數： | 132540 |
| RAM 位總計： | 6747840 |
| 輸入/輸出數： | 742 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 1020-BBGA |
| 供應商設備封裝： | 1020-FBGA（33x33） |
| 其它名稱： | 544-1413 |
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2–22
Altera Corporation
Stratix II Device Handbook, Volume 2
January 2008
Clock Modes
Figure 2–12 shows a TriMatrix memory block in independent clock mode.
Figure 2–12. Stratix II and Stratix II GX TriMatrix Memory Block in Independent
Clock Mode
Note to Figure 2–12:
(1)
Violating the setup or hold time on the memory block address registers could
corrupt the memory contents. This applies to both read and write operations.
6
D
ENA
Q
D
ENA
Q
D
ENA
Q
data_a[
]
address_a[
]
Memory
Block
256
×
16
(2)
512
×
8
1,024
×
4
2,04
8
×
2
4,096
×
1
Data
In
Address
A
Write/Read
Enable
Data
Out
Data
In
Address
B
Write/Read
Enable
Data
Out
enable_a
clock_a
D
ENA
Q
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6
LAB
Ro
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Cloc
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]
6
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]
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]
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Clock
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A
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