參數(shù)資料
型號(hào)： EP1K50FI484-1DX
英文描述： Field Programmable Gate Array (FPGA)
中文描述： 現(xiàn)場(chǎng)可編程門(mén)陣列（FPGA）
文件頁(yè)數(shù)： 57/86頁(yè)
文件大?。?/td> 1263K
代理商： EP1K50FI484-1DX
60
Altera Corporation
ACEX 1K Programmable Logic Device Family Data Sheet
Tables 30 through 36 show EP1K10 device internal and external timing
parameters. All timing specifications for EP1K10 are preliminary.
Table 30. EP1K10 Device LE Timing Microparameters
Symbol
Speed Grade
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
tLUT
0.7
0.8
1.1
ns
tCLUT
0.5
0.6
0.8
ns
tRLUT
0.6
0.7
1.0
ns
tPACKED
0.4
0.5
ns
tEN
0.9
1.0
1.3
ns
tCICO
0.1
0.2
ns
tCGEN
0.4
0.5
0.7
ns
tCGENR
0.1
0.2
ns
tCASC
0.7
0.9
1.1
ns
tC
1.1
1.3
1.7
ns
tCO
0.5
0.7
0.9
ns
tCOMB
0.4
0.5
0.7
ns
tSU
0.7
0.8
1.0
ns
tH
0.9
1.0
1.1
ns
tPRE
0.8
1.0
1.4
ns
tCLR
0.9
1.0
1.4
ns
tCH
2.0
2.5
ns
tCL
2.0
2.5
ns
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