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參數(shù)資料
| 型號(hào)： | EDS1232AATA |
| 廠商： | Elpida Memory, Inc. |
| 英文描述： | 128M bits SDRAM |
| 中文描述： | 128兆位內(nèi)存 |
| 文件頁數(shù)： | 42/55頁 |
| 文件大?。?/td> | 564K |
| 代理商： | EDS1232AATA |
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EDS1232CABB, EDS1232CATA
Preliminary Data Sheet E0247E40 (Ver. 4.0)
42
DQM Control
The DQM mask the DQ data. The UDQM and LDQM mask the upper and lower bytes of the DQ data, respectively.
The timing of UDQM/LDQM is different during reading and writing.
Reading
When data is read, the output buffer can be controlled by DQM. By setting DQM to Low, the output buffer becomes
Low-Z, enabling data output. By setting DQM to High, the output buffer becomes High-Z, and the corresponding
data is not output. However, internal reading operations continue. The latency of DQM during reading is 2 clocks.
Writing
Input data can be masked by DQM. By setting DQM to Low, data can be written. In addition, when DQM is set to
High, the corresponding data is not written, and the previous data is held. The latency of DQM during writing is 0
clock.
CLK
DQ
out 0
out 1
lDOD = 2 Latency
out 3
DQM
High-Z
Reading
CLK
DQ
in 0
in 1
lDID = 0 Latency
in 3
DQM
Writing
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EDS1232AATA-60 | 128M bits SDRAM |
| EDS1232AATA-60-E | 128M bits SDRAM (4M words x 32 bits) |
| EDS1232AATA-60L | 128M bits SDRAM |
| EDS1232AATA-60L-E | 128M bits SDRAM (4M words x 32 bits) |
| EDS1232AATA-75 | 128M bits SDRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EDS1232AATA-60 | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:128M bits SDRAM (4M words x 32 bits) |
| EDS1232AATA-60-E | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:128M bits SDRAM (4M words x 32 bits) |
| EDS1232AATA-60L | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:128M bits SDRAM |
| EDS1232AATA-60L-E | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:128M bits SDRAM (4M words x 32 bits) |
| EDS1232AATA-60TI | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:128M bits SDRAM WTR (Wide Temperature Range) |
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