參數(shù)資料
型號(hào)： DS33R41
廠商： MAXIM INTEGRATED PRODUCTS INC
元件分類： 數(shù)字傳輸電路
英文描述： Inverse-Multiplexing Ethernet Mapper with Quad Integrated T1/E1/J1 Transceivers
中文描述： DATACOM, FRAMER, PBGA400
封裝： 27 X 27 MM, 1.27 MM PITCH, PLASTIC, BGA-400
文件頁(yè)數(shù)： 1/333頁(yè)
文件大?。?/td> 1741K
代理商： DS33R41
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REV: 102105
Note:
Some revisions of this device may incorporate deviations from published specifications known as errata. Multiple revisions of any device
may be simultaneously available through various sales channels. For information about device errata, click here:
www.maxim-ic.com/errata
.
www.maxim-ic.com
GENERAL DESCRIPTION
The DS33R41 extends a 10/100 Ethernet LAN
segment by encapsulating MAC frames in HDLC or
X.86 (LAPS) for transmission over four interleaved
T1/E1/J1 lines using a robust, balanced, and
programmable inverse multiplexing. Four integrated
T1/E1/J1 transceivers provide framing and line
interfacing functionality.
The device performs store-and-forward of packets
with full wire-speed transport capability. The built-in
committed information rate (CIR) controller provides
fractional bandwidth allocation up to the line rate in
increments of 512kbps.
FUNCTIONAL DIAGRAM
FEATURES
10/100 IEEE 802.3 Ethernet MAC (MII and
RMII) Half/Full Duplex with Automatic Flow
Control
Layer 1 Inverse Multiplexing Over Four
T1/E1/J1 Lines Through the Integrated
Framers and LIUs
Supports Up to 7.75ms Differential Delay
Aggregate Bandwidth from Up to Four
T1/E1/J1 Links
T1/E1 Signaling Capability for OAM
HDLC/LAPS Encapsulation with
Programmable FCS, Interframe Fill
CIR Controller Provides Fractional
Allocations in 512kbps Increments
Programmable BERTs
External 16MB, 100MHz SDRAM Buffering
Parallel Microprocessor Interface
1.8V, 3.3V Power Supplies
IEEE 1149.1 JTAG Support
Features continued on page
12
.
APPLICATIONS
Bonded Transparent LAN Service
LAN Extension
Ethernet Delivery Over T1/E1/J1
ORDERING INFORMATION
PART
TEMP RANGE
PIN-PACKAGE
DS33R41
-40
°
C to +85
°
C
400 BGA
DS33R41
Inverse-Multiplexing Ethernet Mapper with
Quad Integrated T1/E1/J1 Transceivers
10/100
MAC
SDRAM
MII/RMII
μ
C
DS33R41
4 T1/E1/J1
TRANSCEIVERS
WITH BERTs
10/100
ETHERNET
PHY
4 INTERLEAVED
SERIAL STREAMS
HDLC/X.86
ETHERNET
MAPPER
T1/E1
LINES
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