參數(shù)資料
型號(hào)： DS21Q55N
廠(chǎng)商： Electronic Theatre Controls, Inc.
英文描述： Quad T1/E1/J1 Transceiver
中文描述： 四路T1/E1/J1收發(fā)器
文件頁(yè)數(shù)： 36/237頁(yè)
文件大?。?/td> 1438K
代理商： DS21Q55N
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DS21Q55 Quad T1/E1/J1 Transceiver
36 of 237
3. PARALLEL PORT
The DS21Q55 is controlled via a nonmultiplexed (MUX = 0) or a multiplexed (MUX = 1) bus by an
external microcontroller or microprocessor. The DS21Q55 can operate with either Intel or Motorola bus
timing configurations. If the BTS pin is tied low, Intel timing will be selected; if tied high, Motorola
timing will be selected. All Motorola bus signals are listed in parentheses (). See the timing diagrams in
the
AC Electrical Characteristics
for more details. Each of the four transceivers has a complete register
set as shown below. There are four individual chip-select signals (
CS1
,
CS2
,
CS3
,
CS4
) that are used
select one of the four transceivers.
3.1 Register Map
Table 3-A. Register Map Sorted by Address
ADDRESS
REGISTER NAME
REGISTER
ABBREVIATION
MSTRREG
IOCR1
IOCR2
T1RCR1
T1RCR2
T1TCR1
T1TCR2
T1CCR1
SSIE1
SSIE2
SSIE3
SSIE4
T1RDMR1
T1RDMR2
T1RDMR3
IDR
INFO1
INFO2
INFO3
—
IIR1
IIR2
SR1
IMR1
SR2
IMR2
SR3
IMR3
SR4
IMR4
SR5
IMR5
PAGE
00
01
02
03
04
05
06
07
08
09
0A
0B
0C
0D
0E
0F
10
11
12
13
14
15
16
17
18
19
1A
1B
1C
1D
1E
1F
Master Mode Register
I/O Configuration Register 1
I/O Configuration Register 2
T1 Receive Control Register 1
T1 Receive Control Register 2
T1 Transmit Control Register 1
T1 Transmit Control Register 2
T1 Common Control Register 1
Software Signaling Insertion Enable 1
Software Signaling Insertion Enable 2
Software Signaling Insertion Enable 3
Software Signaling Insertion Enable 4
T1 Receive Digital Milliwatt Enable Register 1
T1 Receive Digital Milliwatt Enable Register 2
T1 Receive Digital Milliwatt Enable Register 3
Device Identification Register
Information Register 1
Information Register 2
Information Register 3
Reserved
Interrupt Information Register 1
Interrupt Information Register 2
Status Register 1
Interrupt Mask Register 1
Status Register 2
Interrupt Mask Register 2
Status Register 3
Interrupt Mask Register 3
Status Register 4
Interrupt Mask Register 4
Status Register 5
Interrupt Mask Register 5
46
73
74
50
51
52
53
54
97
97
98
98
56
56
56
67
57
157
64
—
48
48
158
159
67
68
69
70
71
72
110
110
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