參數(shù)資料
型號： DS21FT40
元件分類： 通信及網(wǎng)絡
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
文件頁數(shù)： 74/87頁
文件大?。?/td> 386K
代理商： DS21FT40
DS21FT40
74 of 87
DS21FT40 TRANSMIT DATA FLOW
Figure 16-14
Si Bit Insertion
Control
(TCR1.3)
Timeslot 0
Pass-Through
(TCR1.6)
E-Bit Generation
(TCR2.1)
Sa Bit Insertion
Control (TCR2.3
thru TCR2.7)
Idle Code / Channel
Insertion Control via
TIR1/2/3/4
Transmit Unframed All
Ones (TCR1.4) or
Auto AIS (CCR2.5)
Code Word
Generation
CRC4 Enable
(CCR1.4)
TAF
TNAF.5-7
TLINK
TS1 to TS16
TIDR
TPOS,
TNEG
0
1
0
1
1
0
0
1
1
0
0
1
0
1
1
0
Transmit Signaling
All Ones
(TCR1.2)
AIS
Generation
= Register
= Device Pin
= Selector
KEY:
TCBR1/2/3/4
RSER
(note #1)
CCR3.6
TCR1.5
Signaling Bit
Insertion Control
TIR Function Select
(CCR3.5)
AIS
Generation
0
1
NOTES:
1. TCLK should be tied to RCLK and TSYNC should be tied to RFSYNC for
data to be properly sourced from RSER.
2. Auto Remote Alarm if enabled will only overwrite bit 3 of timeslot 0 in the
Not Align Frames if the alarm needs to be sent.
Sa Bit Insertion
Control Register
(TSaCR)
1
0
TSa4 to TSa8
TRA
TSiNAF
TSiAF
CRC4 Multiframe
Alignment Word
Generation (CCR.4)
Receive Side
CRC4 Error
Detector
0
1
Auto Remote Alarm
Generation (CCR2.4)
Per-Channel Code
Generation
(TCC1/2/3/4)
0
1
TC1 to TC32
HDLC
ENGINE
DS0 Data
Source MUX
(TDC1/2)
0
1
TSER
&
TDATA
TAF/TNAF Bit
MUX
0
1
TNAF.0-4
Sa Data Source
MUX
(TDC1)
0
1
DS0 Monitor
TSIG
Hardware
Signaling
Insertion (CCR3.2)
0
1
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PDF描述
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