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參數(shù)資料
| 型號(hào)： | DOC4106 |
| 廠商： | Atmel Corp. |
| 英文描述： | Single-Chip Microcontroller with MP3 Decoder and Man-Machine Interface |
| 中文描述： | 單片微控制器，帶有MP3解碼器和人機(jī)界面 |
| 文件頁(yè)數(shù)： | 37/47頁(yè) |
| 文件大?。?/td> | 791K |
| 代理商： | DOC4106 |
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37
AT8xC51SND1C
4106F–8051–10/02
Two-wire Interface
Timings
Table 47.
TWI Interface AC Timing
zV
DD
= 2.7 to 3.3V, T
A
= -40
°
to +85
°
C
Notes:
1. At 100 kbit/s. At other bit-rates this value is inversely proportional to the bit-rate of
100 kbit/s.
2. Determined by the external bus-line capacitance and the external bus-line pull-up
resistor, this must be < 1
μ
s.
3. Spikes on the SDA and SCL lines with a duration of less than 3·
T
CLCL
will be filtered
out. Maximum capacitance on bus-lines SDA and SCL = 400 pF.
4.
T
CLCL
= T
OSC
= one oscillator clock period.
Waveforms
Figure 23.
TWI Waveforms
Symbol
Parameter
INPUT
Min
Max
OUTPUT
Min
Max
T
HD
; STA
Start condition hold time
14·T
CLCL
(4)
4.0
μ
s
(1)
T
LOW
SCL Low Time
16·T
CLCL
(4)
4.7
μ
s
(1)
T
HIGH
SCL High Time
14·T
CLCL
(4)
4.0
μ
s
(1)
T
RC
SCL Rise Time
1
μ
s
Note
(2)
T
FC
SCL Fall Time
0.3
μ
s
0.3
μ
s
(3)
T
SU
; DAT1
Data Set-up Time
250 ns
20·T
CLCL(4)
- T
RD
T
SU
; DAT2
SDA Set-up Time (before repeated START condition)
250 ns
1
μ
s
(1)
T
SU
; DAT3
SDA Set-up Time (before STOP condition)
250 ns
8·T
CLCL
(4)
T
HD
; DAT
Data Hold Time
0 ns
8·T
CLCL(4)
- T
FC
T
SU
; STA
Repeated START Set-up Time
14·T
CLCL(4)
4.7
μ
s
(1)
T
SU
; STO
STOP condition Set-up Time
14·T
CLCL(4)
4.0
μ
s
(1)
T
BUF
Bus Free Time
14·T
CLCL(4)
4.7
μ
s
(1)
T
RD
SDA Rise Time
1
μ
s
-
(2)
T
FD
SDA Fall Time
0.3
μ
s
0.3
μ
s
(3)
T
SU
;DAT1
T
SU
;
STA
Tsu;DAT
2
T
HD
;STA
T
HIGH
T
LOW
SDA
(INPUT/OUTPUT)
0.3
V
DD
0.7
V
DD
T
buf
T
su
;STO
0.7
V
DD
0.3
V
DD
T
rd
T
FD
T
rc
T
fc
SCL
(INPUT/OUTPUT)
T
HD
DAT
T
su;
DAT3
START or Repeated START Condition
START Condition
STOP Condition
Repeated START Condition
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