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參數(shù)資料
| 型號(hào)： | DOC4106 |
| 廠商： | Atmel Corp. |
| 英文描述： | Single-Chip Microcontroller with MP3 Decoder and Man-Machine Interface |
| 中文描述： | 單片微控制器，帶有MP3解碼器和人機(jī)界面 |
| 文件頁(yè)數(shù)： | 29/47頁(yè) |
| 文件大?。?/td> | 791K |
| 代理商： | DOC4106 |
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29
AT8xC51SND1C
4106F–8051–10/02
AC Characteristics
External 8-bit Bus Cycles
Definition of Symbols
Table 39.
External 8-bit Bus Cycles Timing Symbol Definitions
Timings
Test conditions: capacitive load on all pins = 50 pF.
Table 40.
External 8-bit Bus Cycle – Data Read AC Timings
V
DD
= 2.7 to 3.3V, T
A
= -40
°
to +85
°
C
Signals
Conditions
A
Address
H
High
D
Data In
L
Low
L
ALE
V
Valid
Q
Data Out
X
No Longer Valid
R
RD
Z
Floating
W
WR
Symbol
Parameter
Variable Clock
Standard Mode
Variable Clock
X2 Mode
Unit
Min
Max
Min
Max
T
CLCL
Clock Period
50
50
ns
T
LHLL
ALE Pulse Width
2
·
T
CLCL
-15
T
CLCL
-15
ns
T
AVLL
Address Valid to ALE Low
T
CLCL
-20
0.5
·
T
CLCL
-20
ns
T
LLAX
Address Hold after ALE Low
T
CLCL
-20
0.5
·
T
CLCL
-20
ns
T
LLRL
ALE Low to RD Low
3
·
T
CLCL
-30
1.5
·
T
CLCL
-30
ns
T
RLRH
RD Pulse Width
6
·
T
CLCL
-25
3
·
T
CLCL
-25
ns
T
RHLH
RD High to ALE High
T
CLCL
-20
T
CLCL
+20
0.5
·
T
CLCL
-20
0.5
·
T
CLCL
+20
ns
T
AVDV
Address Valid to Valid Data In
9
·
T
CLCL
-65
4.5
·
T
CLCL
-65
ns
T
AVRL
Address Valid to RD Low
4
·
T
CLCL
-30
2
·
T
CLCL
-30
ns
T
RLDV
RD Low to Valid Data
5
·
T
CLCL
-30
2.5
·
T
CLCL
-30
ns
T
RLAZ
RD Low to address Float
0
0
ns
T
RHDX
Data Hold After RD High
0
0
ns
T
RHDZ
Instruction Float after RD
High
2
·
T
CLCL
-25
T
CLCL
-25
ns
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PDF描述 |
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