參數(shù)資料
型號： DG403DY-T
廠商： Intersil
文件頁數(shù)： 9/12頁
文件大?。?/td> 0K
描述： IC SWITCH DUAL DPST 16SOIC
標(biāo)準(zhǔn)包裝： 2,500
功能： 開關(guān)
電路： 2 x SPDT - NC/NO
導(dǎo)通狀態(tài)電阻： 45 歐姆
電壓電源： 單/雙電源
電壓 - 電源，單路/雙路(±)： 5 V ~ 34 V，±5 V ~ 17 V
電流 - 電源： 10nA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 16-SOIC（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 16-SOIC
包裝： 帶卷 (TR)
6
FN3284.11
November 20, 2006
Application Information
Dual Slope Integrators
The DG403 is well suited to configure a selectable slope
integrator. One control signal selects the timing capacitor C1
or C2. Another one selects eIN or discharges the capacitor in
preparation for the next integration cycle.
Peak Detector
A3 acting as a comparator provides the logic drive for
operating SW1. The output of A2 is fed back to A3 and
compared to the analog input eIN. If eIN > eOUT the output of
A3 is high keeping SW1 closed. This allows C1 to charge up
to the analog input voltage. When eIN goes below eOUT, A3
goes negative, turning SW1 off. The system will therefore
store the most positive analog input experienced.
FIGURE 6. CROSSTALK TEST CIRCUIT
FIGURE 7. CAPACITANCES TEST CIRCUIT
Test Circuits and Waveforms (Continued)
0V, 2.4V
ANALYZER
+15V
V+
C
VS1
SIGNAL
GENERATOR
RL
GND
IN1
VD1
IN2
50
Ω
0V, 2.4V
NC
V-
-15V
C
VD2
+5V
VL
C
VS2
+15V
V+
C
GND
VS
VD
INX
V-
-15V
C
IMPEDANCE
ANALYZER
0V, 2.4V
+5V
VL
C
AS REQUIRED
V-
GND
-15V
IN2
IN1
S3
S1
S2
S4
D1
D2
D3
D4
+15V
+5V
VL
V+
DG403
C1
C2
eOUT
eIN
INTEGRATE/
SCOPE
TTL
RESET
SELECT
FIGURE 8. DUAL SLOPE INTEGRATOR
eOUT
eIN
C1
R1
SW2
SW1
RESET
+
-
+
-
+
-
DG401
A1
A3
FIGURE 9. POSITIVE PEAK DETECTOR
A2
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PDF描述
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