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參數(shù)資料
| 型號(hào)： | CY39200Z484-125BBC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | CPLDs at FPGA Densities |
| 中文描述： | LOADABLE PLD, 10 ns, PBGA484 |
| 封裝： | 23 X 23 MM, 1.6 MM HEIGHT, 1 MM PITCH, FBGA-484 |
| 文件頁(yè)數(shù)： | 51/86頁(yè) |
| 文件大?。?/td> | 1212K |
| 代理商： | CY39200Z484-125BBC |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
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IO7
IO7
IO7
IO7
IO7
IO7
IO7
IO7
IO7
IO7
IO/V
REF7
V
CCIO7
IO7
IO7
IO7
IO7
IO/V
REF7
IO7
IO7
V
CCIO7
IO7
IO/V
REF7
IO7
IO7
IO7
GND
GCLK3
GND
GCTL3
IO/V
REF7
V
CCIO7
IO7
IO7
IO7
IO7
IO/V
REF7
IO7
IO7
V
CCIO7
IO7
IO/V
REF7
IO7
IO7
IO7
GND
GCLK3
GND
GCTL3
IO/V
REF7
V
CCIO7
IO7
IO7
IO7
IO7
IO/V
REF7
IO7
IO7
V
CCIO7
IO7
IO/V
REF7
IO7
IO7
IO7
GND
GCLK3
GND
GCTL3
IO/V
REF7
V
CCIO7
IO7
IO7
IO7
IO7
IO/V
REF7
IO7
IO7
V
CCIO7
IO7
IO/V
REF7
IO7
IO7
IO7
GND
GCLK3
GND
GCTL3
IO/V
REF7
V
CCIO7
IO7
IO7
IO7
IO7
IO/V
REF7
IO7
IO7
V
CCIO7
IO7
IO/V
REF7
IO7
IO7
IO7
GND
GCLK3
GND
GCTL3
Table 11. 208 EQFP/PQFP Pin Table
(continued)
Pin
CY39030
CY39050
CY39100
CY39165
CY39200
Table 12. 388 BGA Pin Table
Pin
A1
A2
A3
A4
A5
A6
A7
A8
A9
A10
A11
A12
A13
[19]
A14
[19]
A15
A16
A17
A18
CY39050
GND
NC
IO7
IO7
IO7
IO7
IO7
NC
IO7
IO7
IO/V
REF7
IO7
IO7
IO6
IO6
GND
IO6
IO6
CY39100
GND
IO7
IO7
IO7
IO7
IO7
IO7
IO/VREF7
IO7
IO7
IO/V
REF7
IO7
IO7
IO6
IO6
GND
IO6
IO6
CY39165
GND
IO7
IO7
IO7
IO7
IO7
IO7
IO/VREF7
IO7
IO7
IO/V
REF7
IO7
IO7
IO6
IO6
GND
IO6
IO6
CY39200
GND
IO7
IO7
IO7
IO7
IO7
IO7
IO/VREF7
IO7
IO7
IO/V
REF7
IO7
IO7
IO6
IO6
GND
IO6
IO6
Note:
19. Capacitance on these I/O pins meets the PCI spec (rev. 2.2), which requires IDSEL pin in a PCI design to have capacitance less than or equal to 8 pf. In the
document titled “Delta39K CPLD Family data sheet”, this spec is defined as C
PCI.
All other I/O pins have a capacitance less than or equal to 10 pf.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY3930Z484-125BBI | CPLDs at FPGA Densities |
| CY3950Z484-125BBI | CPLDs at FPGA Densities |
| CY39100Z484-125BBI | CPLDs at FPGA Densities |
| CY39165Z484-125BBI | TVS 14V 0.1J 32V-CV SMD-0603 SN100 TR-7-PL |
| CY39200Z484-125BBI | CPLDs at FPGA Densities |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY39200Z484-125BBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200Z676-125BBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200Z676-125BBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200Z676-125BGC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200Z676-125BGI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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