參數(shù)資料
型號(hào)： CY39200V388-125MGC
廠商： CYPRESS SEMICONDUCTOR CORP
元件分類： PLD
英文描述： CPLDs at FPGA Densities
中文描述： LOADABLE PLD, 10 ns, PBGA388
封裝： 35 X 35 MM, 1.27 MM PITCH, BGA-388
文件頁(yè)數(shù)： 33/86頁(yè)
文件大?。?/td> 1212K
代理商： CY39200V388-125MGC
Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 33 of 86
Switching Waveforms
(continued)
CLOCK
A
n
A
n
B
n–1
B
n+1
t
CHMBDV
A
n–1
t
CHMBDV
t
CHMS
t
CHMS
ADDRESS B
ADDRESS
MATCH
Dual-Port Synchronous Address Match Busy Signal
ADDRESS A
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PDF描述
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